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參數(shù)資料
| 型號： | MC68HC908JK1ECDW |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 174/180頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 1.5K FLASH 8MHZ 20-SOIC |
| 標(biāo)準(zhǔn)包裝： | 38 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 外圍設(shè)備： | LED，LVD，POR，PWM |
| 輸入/輸出數(shù)： | 15 |
| 程序存儲器容量： | 1.5KB（1.5K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.3 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
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I/O Registers
MC68HC908JL3E Family Data Sheet, Rev. 4
Freescale Semiconductor
93
MSxB — Mode Select Bit B
This read/write bit selects buffered output compare/PWM operation. MSxB exists only in the TIM
channel 0 status and control register. Setting MS0B disables the channel 1 status and control register
and reverts TCH1 to general-purpose I/O.
Reset clears the MSxB bit.
1 = Buffered output compare/PWM operation enabled
0 = Buffered output compare/PWM operation disabled
MSxA — Mode Select Bit A
When ELSxB:ELSxA
≠ 0:0, this read/write bit selects either input capture operation or unbuffered
output compare/PWM operation. See Table 8-3.
1 = Unbuffered output compare/PWM operation
0 = Input capture operation
When ELSxB:ELSxA = 0:0, this read/write bit selects the initial output level of the TCHx pin. (See
Table 8-3.) Reset clears the MSxA bit.
1 = Initial output level low
0 = Initial output level high
NOTE
Before changing a channel function by writing to the MSxB or MSxA bit, set
the TSTOP and TRST bits in the TIM status and control register (TSC).
ELSxB and ELSxA — Edge/Level Select Bits
When channel x is an input capture channel, these read/write bits control the active edge-sensing logic
on channel x. When channel x is an output compare channel, ELSxB and ELSxA control the channel
x output behavior when an output compare occurs. When ELSxB and ELSxA are both clear, channel
x is not connected to an I/O port, and pin TCHx is available as a general-purpose I/O pin. Table 8-3
shows how ELSxB and ELSxA work. Reset clears the ELSxB and ELSxA bits.
NOTE
Before enabling a TIM channel register for input capture operation, make
sure that the TCHx pin is stable for at least two bus clocks.
Table 8-3. Mode, Edge, and Level Selection
MSxB
MSxA
ELSxB
ELSxA
Mode
Configuration
X0
0
Output Preset
Pin under Port Control; Initial Output Level High
X
1
0
Pin under Port Control; Initial Output Level Low
00
0
1
Input Capture
Capture on Rising Edge Only
0
1
0
Capture on Falling Edge Only
0
1
Capture on Rising or Falling Edge
01
0
1
Output
Compare or
PWM
Toggle Output on Compare
0
1
0
Clear Output on Compare
0
1
Set Output on Compare
1X
0
1
Buffered Output
Compare or
Buffered
PWM
Toggle Output on Compare
1
X
1
0
Clear Output on Compare
1
X
1
Set Output on Compare
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