參數(shù)資料
型號(hào)： MC68HC908JK1ECDW
廠商： Freescale Semiconductor
文件頁數(shù)： 97/180頁
文件大小： 0K
描述： IC MCU 1.5K FLASH 8MHZ 20-SOIC
標(biāo)準(zhǔn)包裝： 38
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 15
程序存儲(chǔ)器容量： 1.5KB（1.5K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.3 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x8b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁當(dāng)前第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁
Monitor ROM
MC68HC908JL3E Family Data Sheet, Rev. 4
Freescale Semiconductor
23
Addr.
Register Name
Bit 7
654321
Bit 0
$0000
Port A Data Register
(PTA)
Read:
0
PTA6
PTA5
PTA4
PTA3
PTA2
PTA1
PTA0
Write:
Reset:
Unaffected by reset
$0001
Port B Data Register
(PTB)
Read:
PTB7
PTB6
PTB5
PTB4
PTB3
PTB2
PTB1
PTB0
Write:
Reset:
Unaffected by reset
$0002
Unimplemented
Read:
Write:
$0003
Port D Data Register
(PTD)
Read:
PTD7
PTD6
PTD5
PTD4
PTD3
PTD2
PTD1
PTD0
Write:
Reset:
Unaffected by reset
$0004
Data Direction Register A
(DDRA)
Read:
0
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
00000000
$0005
Data Direction Register B
(DDRB)
Read:
DDRB7
DDRB6
DDRB5
DDRB4
DDRB3
DDRB2
DDRB1
DDRB0
Write:
Reset:
00000000
$0006
Unimplemented
Read:
Write:
$0007
Data Direction Register D
(DDRD)
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
00000000
$0008
↓
$0009
Unimplemented
Read:
Write:
$000A
Port D Control Register
(PDCR)
Read:
0000
SLOWD7
SLOWD6
PTDPU7
PTDPU6
Write:
Reset:
00000000
$000B
↓
$000C
Unimplemented
Read:
Write:
$000D
Port A Input Pull-up Enable
Register (PTAPUE)
Read:
PTA6EN
PTAPUE6
PTAPUE5
PTAPUE4
PTAPUE3
PTAPUE2
PTAPUE1
PTAPUE0
Write:
Reset:
00000000
$000E
↓
$0019
Unimplemented
Read:
Write:
= Unimplemented
R
= Reserved
Figure 2-2. Control, Status, and Data Registers (Sheet 1 of 4)
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PDF描述
1987419-1 CONN PLUG DUST COVER
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