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參數(shù)資料
| 型號： | MCIMX27LMOP4AR2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 99/152頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU I.MX27 IN 19X19 473MAPBGA |
| 標準包裝： | 750 |
| 系列： | i.MX27 |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，LCD，POR，PWM，WDT |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 45K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.38 V ~ 1.52 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 473-LFBGA |
| 包裝： | 帶卷 (TR) |
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i.MX27 and i.MX27L Data Sheet, Rev. 1.8
50
Freescale Semiconductor
Electrical Characteristics
Figure 9 shows sensor output data on the pixel clock falling edge. The CSI latches data on the pixel clock
rising edge.
Figure 9. CSI Timing Diagram, Gated, PIXCLK—Sensor Data at Falling Edge, Latch Data at Rising Edge
Figure 10 shows sensor output data on the pixel clock rising edge. The CSI latches data on the pixel clock
falling edge.
Figure 10. CSI Timing Diagram, Gated, PIXCLK—Sensor Data at Rising Edge, Latch Data at Falling Edge
VSYNC
HSYNC
PIXCLK
DATA[7:0]
Valid Data
1
2
34
56
7
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| MCIMX27LOVP4A | 制造商:Freescale Semiconductor 功能描述: |
| MCIMX27LPDK | 功能描述:開發(fā)板和工具包 - ARM MCIMX27 PDK For LINUX RoHS:否 制造商:Arduino 產(chǎn)品:Development Boards 工具用于評估:ATSAM3X8EA-AU 核心:ARM Cortex M3 接口類型:DAC, ICSP, JTAG, UART, USB 工作電源電壓:3.3 V |
| MCIMX27LV0P4A | 制造商:Freescale Semiconductor 功能描述: |
| MCIMX27LVJP4A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Multimedia Applications Processor |
| MCIMX27LVOP4A | 功能描述:處理器 - 專門應(yīng)用 LOW END I.MX27 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
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