參數(shù)資料
型號(hào)： MCIMX27VOP4
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 400 MHz, MICROPROCESSOR, PBGA404
封裝： 17 X 17 MM, 0.65 MM PITCH, LEAD FEE, MAPBGA-404
文件頁數(shù)： 99/118頁
文件大?。?/td> 1159K
代理商： MCIMX27VOP4
Signal Descriptions
i.MX27 Data Sheet, Advance Information, Rev. 0.1
Freescale Semiconductor
Preliminary—Subject to Change Without Notice
81
Figure 43. SLCDC Timing Diagram—Parallel Transfers to LCD Device
Table 43. SLCDC Serial Interface Timing Parameters
Symbol
Parameter
Min
Typ
Max
Units
tcss
Chip select setup time
(tcyc / 2) (
±) t
prop
——
ns
tcsh
Chip select hold time
(tcyc / 2) (
±) t
prop
——
ns
tcyc
Serial clock cycle time
39 (
±) t
prop
—2641
ns
tcl
Serial clock low pulse
18 (
±) tprop
——
ns
tch
Serial clock high pulse
18 (
±) tprop
——
ns
tds
Data setup time
(tcyc / 2) (±) tprop
——
ns
tdh
Data hold time
(tcyc / 2) (±) tprop
——
ns
trss
Register select setup time
(15 * tcyc / 2) (±) tprop
——
ns
trsh
Register select hold time
(tcyc / 2) (±) tprop
——
ns
Table 44. SLCDC Parallel Interface Timing Parameters
Symbol
Parameter
Min
Typ
Max
Units
tcyc
Parallel clock cycle time
78 (
±) tprop
—4923
tds
Data setup time
(tcyc / 2) (±) tprop
——
tdh
Data hold time
(tcyc / 2) (±) tprop
——
LCD_CLK
LCD_DATA[15:0]
LCD_RS
command data
LCD_CS
display data
trsh
trss
tds
tdh
tcyc
LCD_CLK
LCD_DATA[15:0]
LCD_RS
command data
LCD_CS
display data
trsh
trss
tds
tdh
tcyc
This diagram illustrates the timing when CSPOL=0
This diagram illustrates the timing when CSPOL=1
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PDF描述
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