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參數(shù)資料
| 型號(hào)： | MDS212 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | 12-Port 10/100Mbps Ethernet Switch |
| 中文描述： | 12端口10/100Mbps以太網(wǎng)交換機(jī) |
| 文件頁數(shù)： | 98/111頁 |
| 文件大?。?/td> | 1609K |
| 代理商： | MDS212 |
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MDS212
Data Sheet
98
Zarlink Semiconductor Inc.
h0c8
h108
h148
h188
h1c8
h208
h248
h288
h2c8
ECR2_p3
ECR2_p4
ECR2_p5
ECR2_p6
ECR2_p7
ECR2_p8
ECR2_p9
ECR2_p10
ECR2_p11
Bit [0]
Bit [1]
Bit [31:2]
Link Change interrupts are automatically disabled whenever both MAC Transmitter & Receiver are in Reset
state – i.e. both XR & RR bits are set.
WAS
Link_Change
Reserved
If set, the status counter wrap around signal is masked.
If set, the Link_Up and Link_Down Interrupts are masked.
18.2.12.4 ECR3 - MAC Port Interrupt Status Register
Access:
Address:
Non-Zero-Wait-State,
h0x3*4
h00c
h04c
h08c
h0cc
h10c
h14c
h18c
h1cc
h20c
h24c
h28c
h2cc
Direct Access,
x: port number
ECR3_p0
ECR3_p1
ECR3_p2
ECR3_p3
ECR3_p4
ECR3_p5
ECR3_p6
ECR3_p7
ECR3_p8
ECR3_p9
ECR3_p10
ECR3_p11
Read only
Bit [0]
Bit [1]
WAS
Link_Change
Wrapped around signal.
This bit is set when the MAC determines that the status of
physical link has been changed
0=Link Down,
1=Link UP
This bit is reset whenever the PHY has identified the lost of
physical link integrity.
Bit [2]
LK_UP
Bit [31:3]
Reserved
31
2
1
‘ 0
Mask
31
3
2
1
0
Status
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MDS212CG | 12-Port 10/100Mbps Ethernet Switch |
| MDS213 | 12-Port 10/100Mbps + 1Gbps Ethernet Switch |
| MDS213CG | 12-Port 10/100Mbps + 1Gbps Ethernet Switch |
| MDS220 | Analog IC |
| MDS221 | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MDS212CG | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:12-Port 10/100Mbps Ethernet Switch |
| MDS213 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:12-Port 10/100Mbps + 1Gbps Ethernet Switch |
| MDS213CG | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:12-Port 10/100Mbps + 1Gbps Ethernet Switch |
| MDS217 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| MDS-21E09 | 制造商:ITT Interconnect Solutions 功能描述:BACKSHELL - Bulk |
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