參數資料
型號： MK60DX256ZVLL10
廠商： Freescale Semiconductor
文件頁數： 10/1809頁
文件大?。?/td> 0K
描述： IC ARM CORTEX MCU 256KB 100LQFP
標準包裝： 450
系列： Kinetis
核心處理器： ARM? Cortex?-M4
芯體尺寸： 32-位
速度： 100MHz
連通性： CAN，EBI/EMI，以太網，I²C，IrDA，SDHC，SPI，UART/USART，USB，USB OTG
外圍設備： DMA，I²S，LVD，POR，PWM，WDT
輸入/輸出數： 66
程序存儲器容量： 256KB（256K x 8）
程序存儲器類型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.71 V ~ 3.6 V
數據轉換器： A/D 25x16b，D/A 1x12b
振蕩器型： 內部
工作溫度： -40°C ~ 105°C
封裝/外殼： 100-LQFP
包裝： 托盤
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FTM counter
CNTIN
C(n+1)V
not fully 0% duty cycle
channel (n) output
with ELSnB:ELSnA = 1:0
not fully 100% duty cycle
channel (n) output
with ELSnB:ELSnA = X:1
MOD = C(n)V
Figure 39-202. Channel (n) Output If (C(n+1)V > MOD) and (CNTIN < C(n)V = MOD)
39.4.8.1 Asymmetrical PWM
In combine mode, the control of the PWM signal first edge (when the channel (n) match
occurs, that is, FTM counter = C(n)V) is independent of the control of the PWM signal
second edge (when the channel (n+1) match occurs, that is, FTM counter = C(n+1)V).
So, combine mode allows the generation of asymmetrical PWM signals.
39.4.9 Complementary Mode
The complementary mode is selected when (FTMEN = 1), (QUADEN = 0), (DECAPEN
= 0), (COMBINE = 1), (CPWMS = 0), and (COMP = 1).
In complementary mode the channel (n+1) output is the inverse of the channel (n) output.
If (FTMEN = 1), (QUADEN = 0), (DECAPEN = 0), (COMBINE = 1), (CPWMS = 0),
and (COMP = 0), then the channel (n+1) output is the same as the channel (n) output.
Functional Description
K60 Sub-Family Reference Manual, Rev. 6, Nov 2011
1006
Freescale Semiconductor, Inc.
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