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參數(shù)資料
| 型號： | MPC106ARX83DG |
| 廠商： | MOTOROLA INC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI Bridge/Memory Controller |
| 中文描述： | PCI BUS CONTROLLER, CBGA304 |
| 封裝： | 21 X 25 MM, 3.16 MM HEIGHT, 1.27 MM PITCH, CERAMIC, BGA-304 |
| 文件頁數(shù)： | 13/28頁 |
| 文件大?。?/td> | 158K |
| 代理商： | MPC106ARX83DG |
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MPC106 PCI Bridge/Memory Controller Hardware Specifications
13
Electrical and Thermal Characteristics
Figure 6 provides the JTAG clock input timing diagram.
Figure 6. JTAG Clock Input Timing Diagram
Figure 7 provides the TRST timing diagram.
Figure 7. TRST Timing Diagram
6
Boundary-scan input data setup time
5
—
ns
3
7
Boundary-scan input data hold time
15
—
ns
3
8
TCK to output data valid
0
30
ns
4
9
TCK to output high impedance
0
30
ns
4
10
TMS, TDI data setup time
5
—
ns
—
11
TMS, TDI data hold time
15
—
ns
1
12
TCK to TDO data valid
0
15
ns
—
13
TCK to TDO high impedance
0
15
ns
—
Notes
:
1
These values are guaranteed by design, and are not tested
2
TRST is an asynchronous signal. The setup time is for test purposes only.
3
Non-test signal input timing with respect to TCK.
4
Non-test signal output timing with respect to TCK.
Table 9. JTAG AC Timing Specifications (Independent of SYSCLK) (Continued)
Num
Characteristic
Min
Max
Unit
Notes
TCK
2
2
1
3
3
VM = Midpoint Voltage (1.4 V)
VM
VM
VM
4
5
TRST
TCK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC106ARX83TE | PCI Bridge/Memory Controller |
| MPC106ARX83TG | PCI Bridge/Memory Controller |
| MPC2003SG50 | 256KB and 512KB BurstRAM Secondary Cache Module for PowerPC - Based Systems |
| MPC2002SG50 | 256KB and 512KB BurstRAM Secondary Cache Module for PowerPC - Based Systems |
| MPC2002SG60 | 256KB and 512KB BurstRAM Secondary Cache Module for PowerPC - Based Systems |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC106ARX83TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX83TG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
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| MPC108101J | 制造商:TE Connectivity 功能描述:RESISTOR 10 WATT 100R 5% |
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