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參數(shù)資料
| 型號： | MPC8547ECPXAQGB |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 77/151頁 |
| 文件大?。?/td> | 0K |
| 描述： | MPU POWERQUICC III 783-PBGA |
| 標準包裝： | 1 |
| 系列： | MPC85xx |
| 處理器類型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 1.0GHz |
| 電壓： | 1.1V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 783-BBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 783-FCPBGA（29x29） |
| 包裝： | 托盤 |
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MPC8548E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 9
Freescale Semiconductor
31
Enhanced Three-Speed Ethernet (eTSEC)
Figure 8 shows the GMII transmit AC timing diagram.
Figure 8. GMII Transmit AC Timing Diagram
8.2.2.2
GMII Receive AC Timing Specifications
This table provides the GMII receive AC timing specifications.
Figure 9 provides the AC test load for eTSEC.
Figure 9. eTSEC AC Test Load
Table 27. GMII Receive AC Timing Specifications
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
RX_CLK clock period
tGRX
—8.0
—
ns
RX_CLK duty cycle
tGRXH/tGRX
35
—
75
ns
RXD[7:0], RX_DV, RX_ER setup time to RX_CLK
tGRDVKH
2.0
—
ns
RXD[7:0], RX_DV, RX_ER hold time to RX_CLK
tGRDXKH
0—
—
ns
RX_CLK clock rise (20%-80%)
tGRXR
2
——
1.0
ns
RX_CLK clock fall time (80%-20%)
tGRXF
2
——
1.0
ns
Notes:
1. The symbols used for timing specifications follow the pattern of t(first two letters of functional block)(signal)(state)(reference)(state) for
inputs and t(first two letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tGRDVKH symbolizes GMII receive
timing (GR) with respect to the time data input signals (D) reaching the valid state (V) relative to the tRX clock reference (K)
going to the high state (H) or setup time. Also, tGRDXKL symbolizes GMII receive timing (GR) with respect to the time data
input signals (D) went invalid (X) relative to the tGRX clock reference (K) going to the low (L) state or hold time. Note that, in
general, the clock reference symbol representation is based on three letters representing the clock of a particular functional.
For example, the subscript of tGRX represents the GMII (G) receive (RX) clock. For rise and fall times, the latter convention
is used with the appropriate letter: R (rise) or F (fall).
2. Guaranteed by design.
GTX_CLK
TXD[7:0]
tGTKHDX
tGTX
tGTXH
tGTXR
tGTXF
tGTKHDV
TX_EN
TX_ER
Output
Z0 = 50
LVDD/2
RL = 50
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC8568VTAUJJ | MPU POWERQUICC III 1023-PBGA |
| MPC8547EVTATGB | MPU POWERQUICC III 783-PBGA |
| IDT71T75802S166PFGI8 | IC SRAM 18MBIT 166MHZ 100TQFP |
| AMC17DTEH | CONN EDGECARD 34POS .100 EYELET |
| FMC40DRYI-S13 | CONN EDGECARD 80POS .100 EXTEND |
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參數(shù)描述 |
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