參數(shù)資料
型號： MQ83C154DXXX-25/883R
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQFP44
封裝： CERAMIC, QFP-44
文件頁數(shù)： 787/832頁
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代理商： MQ83C154DXXX-25/883R
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807
6384E–ATARM–05-Feb-10
AT91SAM9G20
None.
44.2.7.3
SSC: Transmitter Limitations in Slave Mode
If TK is programmed as output and TF is programmed as input, it is impossible to emit data
when start of edge (rising or falling) of synchro with a Start Delay equal to zero.
Problem Fix/Workaround
None.
44.2.7.4
SSC: Periodic Transmission Limitations in Master Mode
If Last Significant Bit is sent first (MSBF = 0) the first TAG during the frame synchro is not sent.
Problem Fix/Workaround
None.
44.2.8
Shutdown Controller (SHDWC)
44.2.8.1
SHDWC: SHDN Signal may be Driven to Low Level Voltage During Device Power-on
If only VDDBU is powered during boot sequence (No VDDCORE), the SHDN signal may be
driven to low level voltage after a delay.This delay is linked to the startup time of the slow clock
selected by OSCSEL signal.
If SHDN pin is connected to the Enable pin (EN) of the VDDCORE regulator, VDDCORE estab-
lishment does not occur and the system does not start.
Problem Fix/Workaround
1.
VDDCORE must be established within the delay corresponding to the startup time of
the slow clock selected by OSCSEL.
2.
Add a glue logic to latch the rising edge of the SHDN signal. The reset of the latch out-
put (EN_REG) can be connected to a PIO and used to enter the shutdown mode.
44.2.9
Static Memory Controller (SMC)
44.2.9.1
SMC: Chip Select Parameters Modification
The user must not change the configuration parameters of an SMC Chip Select (Setup, Pulse,
Cycle, Mode) if accesses are performed on this CS during the modification.
For example, the modification of the Chip Select 0 (CS0) parameters, while fetching the code
from a memory connected on this CS0, may lead to unpredictable behavior.
Problem Fix/Workaround
The code used to modify the parameters of an SMC Chip Select can be executed from the inter-
nal RAM or from a memory connected to another Chip Select
44.2.10
System Controller (SYSC)
44.2.10.1
SYSC: Possible Event Loss when reading RTT_SR
If an event (RTTINC or ALMS) occurs within the same slow clock cycle as when the RTT_SR is
read, the corresponding bit might be cleared. This can lead to the loss of this event.
Problem Fix/Workaround
The software must handle an RTT event as an interrupt and should not poll RTT_SR.
相關PDF資料
PDF描述
IQ80C52TXXX-30 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CQFP44
IR80C52CXXX-12 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44
MD80C52EXXX-36 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CDIP40
MQ83C154XXX-12P883 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQFP44
MQHSMCJ5550 5 A, SILICON, RECTIFIER DIODE, DO-214AB
相關代理商/技術參數(shù)
參數(shù)描述
MQ83C154-L16 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller
MQ83C154T-12 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller
MQ83C154T-16 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller
MQ83C154T-20 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller
MQ83C154T-25 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller
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