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參數(shù)資料
| 型號： | MSM54V24632A |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | 131,072-Word x 32-Bit x 2-Bank SGRAM without Graphics Functions |
| 中文描述： | 131,072字× 32位× 2，銀行SGRAM無圖形功能 |
| 文件頁數(shù)： | 22/29頁 |
| 文件大?。?/td> | 401K |
| 代理商： | MSM54V24632A |
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23
MSM54V24632A
Semiconductor
Clock Suspension & DQM Operation Cycle
@
CAS
Latency = 2, Burst Length = 4
*Notes:
1. When CKE is deactivated, the next clock cycle will be ignored.
2. When DQMs are asserted, the read data after two clock cycles will be masked.
3. When DQMs are asserted, the write data in the same clock cycle will be masked.
4. When DQM0 is set High, the input/output data of DQ0 - DQ7 will be masked.
When DQM2 is set High, the input/output data of DQ8 - DQ15 will be masked.
When DQM3 is set High, the input/output data of DQ16 - DQ23 will be masked.
When DQM4 is set High, the input/output data of DQ24 - DQ31 will be masked.
CLOCK
Suspension
CLK
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
CKE
RAS
CAS
ADDR
DQ0 - 7
WE
DQM1
Ra
CS
Ca
Cb
A9
A8
Row Active
Qb1
Qb0
Read
Command
Read
Command
Read DQM
Write
Command
CLOCK
Suspension
Write
DQM
Read DQM
Cc
t
OHZ
Dc2
Dc0
Qa1
Qa0
Qa2
t
OHZ
Write
DQM
*Note1
¨
*Note1
*Note4
DQ8 - 15
Qb1
Qb0
Dc1
Dc0
Qa2
DQM0
*Note4
Qa0
Qa3
*Note2
*Note3
¨
Read
DQM
Ra
相關PDF資料 |
PDF描述 |
|---|---|
| MSM54V25632A | 131,072-Word x 32-Bit x 2-Bank Synchronous Graphics RAM |
| MSM54V32126 | 131,072-Word x 32-Bit DYNAMIC RAM : FAST PAGE MODE TYPE WITH EDO |
| MSM54V32128 | 131,072-Word x 32-Bit DYNAMIC RAM : FAST PAGE MODE TYPE WITH EDO |
| MSM54V16272 | 262,144-Word x 16-Bit Multiport DRAM |
| MSM54V16273 | 262,144-Word x 16-Bit Multiport DRAM |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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