參數(shù)資料
型號(hào)： ORT82G5
英文描述： ORCA ORT82G5 1.0.1-25/2.0-2.5/3.125 Gbits/s Backplane Interface FPSC
中文描述： ORCA的ORT82G5 1.0.1-25/2.0-2.5/3.125 Gb /秒背板接口促進(jìn)文化基金
文件頁數(shù)： 66/92頁
文件大?。?/td> 1823K
代理商： ORT82G5
66
Agere Systems Inc.
Preliminary Data Sheet
July 2001
1.0-1.25/2.0-2.5/3.125 Gbits/s Backplane Interface
ORCA
ORT82G5 FPSC Eight-Channel
Pin Information
(continued)
In
Table 26, an input refers to a signal flowing into the embedded core and an output refers to a signal flowing out
of the embedded core.
Table 26. Embedded Core/FPGA Interface Signal Description
Pin Name
I/O
Description
Memory Block Interface Signals
AR_A[10:0]
AR_B[10:0]
AW_A[10:0]
AW_B[10:0]
BYTEWN_A[3:0]
BYTEWN_B[3:0]
CKR_A
CKR_B
CKW_A
CKW_B
CSR_A
CSR_B
CSWA_A
CSWA_B
CSWB_A
CSWB_B
D_A[35:0]
D_B[35:0]
Q_A[35:0]
Q_B[35:0]
I
I
I
I
I
I
I
I
I
I
I
I
I
I
I
I
I
I
Read address
—
memory block A.
Read address
—
memory block B.
Write address
—
memory block A.
Write address
—
memory block B.
Write control pins for byte-at-a-time write-memory block A.
Write control pins for byte-at-a-time write-memory block B.
Read clock
—
memory block A.
Read clock
—
memory block B.
Write clock
—
memory block A.
Write clock
—
memory block A.
Read chip select
—
memory block A.
Read chip select
—
memory block A.
Write chip select A
—
memory block A.
Write chip select A
—
memory block B.
Write chip select B
—
memory block A.
Write chip select B
—
memory block B.
Data in
—
memory block A
Data in
—
memory block B.
Data out
—
memory block A.
Data out
—
memory block B.
O
O
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PDF描述
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