參數(shù)資料
型號： PCK2014ADL
廠商： NXP SEMICONDUCTORS
元件分類： XO, clock
英文描述： CK98 100/133 MHz spread spectrum system clock generator
中文描述： 133 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： 7.50 MM, PLASTIC, SSOP-56
文件頁數(shù)： 9/16頁
文件大小： 105K
代理商： PCK2014ADL
Philips Semiconductors
Product specification
PCK2014A
CK98 (100/133 MHz) spread spectrum
system clock generator
2001 Apr 02
9
3V66 CLOCK OUTPUT, 3V66 (0–1) (LUMP CAPACITANCE TEST LOAD = 30 pF)
SYMBOL
PARAMETER
LIMITS
T
amb
= 0 to +70
°
C
133 MHz MODE
MIN
15.0
LIMITS
T
amb
= 0 to +70
°
C
100 MHz MODE
MIN
15.0
UNIT
NOTES
MAX
15.3
MAX
15.3
T
HKP
T
HKH
T
HKL
T
HRISE
T
HFALL
T
JITTER
DUTY CYCLE
3V66 CLK period
ns
2, 9, 4
3V66 CLK HIGH time
4.95
n/a
4.95
n/a
ns
5, 10
3V66 CLK LOW time
4.55
n/a
4.55
n/a
ns
6, 10
3V66 CLK rise time
0.5
2.0
0.5
2.0
ns
8
3V66 CLK fall time
0.5
2.0
0.5
2.0
ns
8
3V66 CLK cycle-cycle jitter
500
500
ps
3V66 CLK Duty Cycle
45
55
45
55
%
1
T
HSKW
3V66 CLK pin-pin skew
250
250
ps
2
48MHZ CLOCK OUTPUT (LUMP CAPACITANCE TEST LOAD = 20 pF)
SYMBOL
PARAMETER
LIMITS 133 MHz
T
amb
= 0 to +70
°
C
MIN
LIMITS 100 MHz
T
amb
= 0 to +70
°
C
MIN
UNIT
NOTES
MAX
MAX
T
HKP
T
HKH
T
HKL
48 MHz clock period average
20.83
20.83
20.83
20.83
ns
2
48 MHz clock HIGH time
7.57
n/a
7.57
n/a
ns
48 MHz clock LOW time
7.17
n/a
7.17
n/a
ns
T
HRISE
(t
R
)
T
HFALL
(t
F
)
DUTY CYCLE (t
D
)
T
JITTER
T
HSTB
(f
ST
)
NOTE:
1. See Figure 5 for measure points.
2. Average period over 1
μ
s.
Output rise edge rate
1
4
1
4
ns
Output fall edge rate
1
4
1
4
ns
Duty Cycle
45
55
45
55
%
CLK cycle-cycle jitter
500
500
ps
Frequency stabilization from Power-up (cold start)
3
ms
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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