參數(shù)資料
型號(hào)： PIC16C712-04/SO
廠商： Microchip Technology
文件頁(yè)數(shù)： 40/106頁(yè)
文件大?。?/td> 0K
描述： IC MCU OTP 1KX14 A/D PWM 18SOIC
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 42
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 4MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 1.75KB（1K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 18-SOIC（0.295"，7.50mm 寬）
包裝： 管件
2005 Microchip Technology Inc.
DS41106B-page 37
PIC16C712/716
6.1
Timer2 Operation
Timer2 can be used as the PWM time base for PWM
mode of the CCP module.
The TMR2 register is readable and writable, and is
cleared on any device Reset.
The input clock (FOSC/4) has a prescale option of 1:1,
1:4
or
1:16,
selected
by
control
bits
T2CKPS1:T2CKPS0 (T2CON<1:0>).
The match output of TMR2 goes through a 4-bit
postscaler (which gives a 1:1 to 1:16 scaling inclusive)
to generate a TMR2 interrupt (latched in flag bit
TMR2IF, (PIR1<1>)).
The prescaler and postscaler counters are cleared
when any of the following occurs:
a write to the TMR2 register
a write to the T2CON register
any device Reset (Power-on Reset, MCLR Reset,
Watchdog Timer Reset, or Brown-out Reset)
TMR2 is not cleared when T2CON is written.
6.2
Timer2 Interrupt
The Timer2 module has an 8-bit period register PR2.
Timer2 increments from 00h until it matches PR2 and
then resets to 00h on the next increment cycle. PR2 is
a readable and writable register. The PR2 register is
initialized to FFh upon Reset.
TABLE 6-1:
REGISTERS ASSOCIATED WITH TIMER2 AS A TIMER/COUNTER
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR,
BOR
Value on
all other
Resets
0Bh,8Bh
INTCON
GIE
PEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x
0000 000u
0Ch
PIR1
—
ADIF
—
CCP1IF
TMR2IF
TMR1IF
-00- -000
0000 -000
8Ch
PIE1
—
ADIE
—
CCP1IE
TMR2IE
TMR1IE
-0-- -000
0000 -000
11h
TMR2
Timer2 Module’s Register
0000 0000
12h
T2CON
—
TOUTPS3 TOUTPS2 TOUTPS1 TOUTPS0
TMR2ON
T2CKPS1
T2CKPS0
-000 0000
92h
PR2
Timer2 Period Register
1111 1111
Legend:
x
= unknown, u = unchanged, — = unimplemented read as ‘0’. Shaded cells are not used by the Timer2 module.
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PDF描述
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W2L16C334MAT1A CAP CER 0.33UF 6.3V 20% X7R 0508
W2L14D684MAT1S CAP CER 0.68UF 4V 20% X7R 0508
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參數(shù)描述
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