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參數(shù)資料
| 型號： | PSD813F5 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| 中文描述： | Flash在系統(tǒng)可編程ISP的外設(shè)的8位微控制器 |
| 文件頁數(shù)： | 32/110頁 |
| 文件大小： | 1685K |
| 代理商： | PSD813F5 |
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PSD813F1
32/110
Separate Space Modes
Code memory space is separated from data mem-
ory space. For example, the PSEN signal is used
to access the program code from the Flash Mem-
ory, while the RD signal is used to access data
from the EEPROM, SRAM and I/O Ports. This
configuration requires the VM register to be set to
0Ch. See
Figure 12.
Combined Space Modes
The program and data memory spaces are com-
bined into one space that allows the main Flash
Memory, EEPROM, and SRAM to be accessed by
either PSEN or RD. For example, to configure the
main Flash memory in combined space mode, bits
2 and 4 of the VM register are set to
“
1
”
(see Figure
13
).
Figure 12. 80C31 Memory Modes - Separate Space
Figure 13. 80C31 Memory Mode - Combined Space
Flash
Memory
DPLD
EEPROM
Memory
SRAM
RS0
EES0-EES3
FS0-FS7
CS
CS
CS
OE
OE
RD
PSEN
OE
AI09222
Flash
Memory
DPLD
EEPROM
Memory
SRAM
RS0
EES0-EES3
FS0-FS7
RD
CS
CS
CS
RD
OE
OE
VM REG BIT 2
PSEN
VM REG BIT 0
VM REG BIT 1
VM REG BIT 3
VM REG BIT 4
OE
AI09223
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PDF描述 |
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