參數(shù)資料
型號(hào)： Q67003H9339
廠商： SIEMENS AG
英文描述： ICs for Communications
中文描述： 通信集成電路
文件頁(yè)數(shù)： 136/397頁(yè)
文件大?。?/td> 1987K
代理商： Q67003H9339
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PEB 22554
Operational Description E1
Semiconductor Group
136
09.98
System Interface Control 2 (Read/Write)
Value after RESET: 00
H
FFS …
Force Freeze Signaling
Setting this bit disables updating of the receive signaling buffer and
current signaling information is frozen. After resetting this bit and
receiving a complete superframe updating of the signaling buffer is
started again. The freeze signaling status could be also automatically
generated by detecting the Loss of Signal alarm or a Loss of CAS
Frame Alignment or a receive slip (only if external register access via
RSIG is enabled). This automatic freeze signaling function is logically
ored with this bit.
The current internal freeze signaling status is output on pin RP(A-D)
/ pin function FREEZ which is selected by PC(1-4).RPC(2-0) = 110.
Additionally this status is also available in register SIS.SFS.
SSF …
Serial Signaling Format
Only applicable if pin function R/XSIG is selected.
0…
Bits 1-4 in all time-slots except time-slots 0 +16 are cleared.
1…
Bits 1-4 in all time-slots except time-slots 0 +16 are set high.
CRB …
Center Receive Elastic Buffer
Only applicable if the time-slot assigner is disabled ( PC1-4.RPC2-0
= 001 ) , no external or internal synchronous pulse receive is
generated.
A transition from low to high will force a receive slip and the read-
pointer of the receive elastic buffer is centered. The delay through the
buffer is set to one half of the current buffer size. It should be hold high
for at least two 2.048 MHz periods before it is cleared.
SICS2 …0
System Interface Channel Select
Only applicable if the system clock rate is greater than 2.048 MHz .
Received data is transmitted on pin RDO / RSIG or received on XDI
/ XSIG with the selected system data rate. If the data rate is greater
than 2.048 MBit/s the data is output or sampled in half , a quarter or
a 1/8 of the 125 μsec. They will not be repeated. The time where the
data is active during a 488 nsec time-slot is called in the following a
channel phase. RDO / RSIG are cleared while XDI / XSIG are
7
0
SIC2
FFS
SSF
CRB
SICS2
SICS1
SICS0
(x3F)
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PDF描述
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