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參數(shù)資料
| 型號(hào)： | SC2200UCL-300 |
| 廠商： | National Semiconductor Corporation |
| 元件分類(lèi)： | 微處理器 |
| 英文描述： | Thin Client On a Chip |
| 中文描述： | 瘦客戶機(jī)片上 |
| 文件頁(yè)數(shù)： | 11/433頁(yè) |
| 文件大?。?/td> | 3255K |
| 代理商： | SC2200UCL-300 |
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Revision 3.0
11
www.national.com
G
Architecture Overview
(Continued)
1.1
The GX1 processor (silicon revision 8.1.1) is the central
module of the SC2200. For detailed information regarding
the GX1 module, refer to the G
eode GX1 Processor Series
datasheet
and the
Geode GX1 Processor Series Silicon
Revision 8.1.1 errata
.
GX1 MODULE
The SC2200’s device ID is contained in the GX1 module.
Software can detect the revision by reading the DIR0 and
DIR1 Configuration registers (see Configuration registers
in the G
eode GX1 Processor Series datasheet
). The
SC2200 device errata contains the specific values.
1.1.1
The GX1 module is connected to external SDRAM devices.
For more information see Section 2.4.2 "Memory Interface
Signals" on page 57, and the "Memory Controller" chapter
in the
GX1 Processor Series datasheet
.
Memory Controller
There are some differences in the SC2200’s memory con-
troller and the stand-alone GX1 processor’s memory con-
troller:
1)
There is drive strength/slew control in the SC2200 that
is not in the GX1. The bits that control this function are
in the MC_MEM_CNTRL1 and MC_MEM_CNTRL2
registers. In the GX1 processor, these bits are marked
as reserved.
2)
The SC2200 supports two banks of memory. The GX1
supports four banks of memory. In addition, the
SC2200 supports a maximum of eight devices and the
GX1 supports up to 32 devices. With this difference,
the MC_BANK_CFG register is different.
Table 1-1 summarizes the 32-bit registers contained in the
SC2200’s memory controller. Table 1-2 gives detailed reg-
ister/bit formats.
Table 1-1. SC2200 Memory Controller Register Summary
GX_BASE+
Memory Offset
Width
(Bits)
Type
Name/Function
Reset Value
8400h-8403h
32
R/W
MC_MEM_CNTRL1.
Memory Controller Control Register 1
248C0040h
8404h-8407h
32
R/W
MC_MEM_CNTRL2.
Memory Controller Control Register 2
00000801h
8408h-840Bh
32
R/W
MC_BANK_CFG.
Memory Controller Bank Configuration
41104110h
840Ch-840Fh
32
R/W
MC_SYNC_TIM1.
Memory Controller Synchronous Timing
Register 1
2A733225h
8414h-8417h
32
R/W
MC_GBASE_ADD.
Memory Controller Graphics Base
Address Register
00000000h
8418h-841Bh
32
R/W
MC_DR_ADD.
Memory Controller Dirty RAM Address
Register
00000000h
841Ch-841Fh
32
R/W
MC_DR_ACC.
Memory Controller Dirty RAM Access
Register
0000000xh
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