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參數(shù)資料
| 型號(hào)： | SC2200UCL-300 |
| 廠商： | National Semiconductor Corporation |
| 元件分類(lèi)： | 微處理器 |
| 英文描述： | Thin Client On a Chip |
| 中文描述： | 瘦客戶(hù)機(jī)片上 |
| 文件頁(yè)數(shù)： | 214/433頁(yè) |
| 文件大小： | 3255K |
| 代理商： | SC2200UCL-300 |
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www.national.com
214
Revision 3.0
G
Core Logic Module
(Continued)
0
Primary Hard Disk Access Trap.
0: Disable.
1: Enable.
If this bit is enabled and an access occurs in the address ranges selected in F0 Index 93h[5], an SMI is generated.
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[0].
Second level SMI status is reported at F0 Index 86h/F6h[0].
Index 83h
Power Management Enable Register 4 (R/W)
Reset Value: 00h
7
Secondary Hard Disk Idle Timer Enable.
Turn on Secondary Hard Disk Idle Timer Count Register (F0 Index ACh) and
generate an SMI when the timer expires.
0: Disable.
1: Enable.
If an access occurs in the address ranges selected in F0 Index 93h[4], the timer is reloaded with the programmed count.
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[0].
Second level SMI status is reported at F0 Index 86h/F6h[4].
Secondary Hard Disk Access Trap.
If this bit is enabled and an access occurs in the address ranges selected in F0 Index
93h[4], an SMI is generated.
0: Disable.
1: Enable.
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[0].
Second level SMI status is reported at F0 Index 86h/F6h[5].
ACPI Timer SMI.
Allow SMI generation for MSB toggles on the ACPI Timer (F1BAR0+I/O Offset 1Ch or
F1BAR1+I/O Offset 1Ch).
0: Disable.
1: Enable.
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[0].
Second level SMI status is reported at F0 Index 87h/F7h[0].
THRM# SMI.
Allow SMI generation on assertion of THRM#.
0: Disable.
1: Enable.
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[0].
Second level SMI status is reported at F0 Index 87h/F7h[6].
VGA Timer Enable.
Turn on VGA Timer Count Register (F0 Index 8Eh) and generate an SMI when the timer reaches 0.
0: Disable.
1: Enable.
If an access occurs in the programmed address range, the timer is reloaded with the programmed count. F0 Index 8Bh[6]
selects the timebase for the VGA Timer.
SMI status is reported at F1BAR0+I/O Offset 00h/02h[6] (top level only).
Video Retrace Interrupt SMI.
Allow SMI generation whenever video retrace occurs.
0: Disable.
1: Enable.
This information is decoded from the serial connection (PSERIAL register, bit 7) from the GX1 module. This function is nor-
mally not used for power management but for soft (VSA) VGA routines.
SMI status reporting is at F1BAR0+I/O Offset 00h/02h[5] (top level only).
General Purpose Timer 2 Enable.
Turn on GP Timer 2 Count Register (F0 Index 8Ah) and generate an SMI when the timer
expires.
0: Disable.
1: Enable.
This idle timer is reloaded from the assertion of GPIO7 (if programmed to do so). GP Timer 2 programming is at F0 Index
8Bh[5,3,2].
Top level SMI status is reported at F1BAR0+I/O Offset 00h/02h[9].
Second level SMI status is reported at F1BAR0+I/O Offset 04h/06h[1].
6
5
4
3
2
1
Table 5-29. F0: PCI Header and Bridge Configuration Registers for GPIO and LPC Support (Continued)
Bit
Description
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PDF描述 |
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