(VDD = 2.5 V ±10%, or 3.3 V ±10%, T
參數(shù)資料
型號： SI5350B-A-GT
廠商： Silicon Laboratories Inc
文件頁數(shù)： 20/24頁
文件大?。?/td> 0K
描述： IC CLK GEN PLL BLANK CUST 10MSOP
標(biāo)準(zhǔn)包裝： 50
系列： MultiSynth™
類型： *
PLL： 是
輸入： 晶體
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:3
差分 - 輸入:輸出： 無/無
頻率 - 最大： 133MHz
除法器/乘法器： 是/無
電源電壓： 2.25 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應(yīng)商設(shè)備封裝： 10-MSOP
包裝： 管件
Si5350B
Rev. 0.9
5
Table 3. AC Characteristics
(VDD = 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85°C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
VCXO Control Voltage Range
Vc
0
VDD/2
VDD
V
VCXO Gain (configurable)
kv
Vc = 10–90% of VDD
18
—
150
ppm/V
VCXO Control Voltage Linearity
KVL
Vc = 10–90% of VDD
–5
—
+5
%
VCXO Pull Range
(configurable)*
PR
VDD = 3.3 V
Vc = 10–90% of VDD
±30
0
±240
ppm
VCXO Modulation Bandwidth
—
10
—
kHz
Power-Up Time
TRDY
From VDD =VDDmin to valid
output clock, CL =5pF,
fCLKn > 1 MHz
—2
10
ms
Power-Down Time
TPD
From VDD =VDDmin,
CL =5pF, fCLKn >1MHz
—5
100
ms
Output Enable Time
TOE
From OEB assertion to valid
clock output, CL =5pF,
fCLKn > 1 MHz
——
10
s
Output Frequency Transition
Time
TFREQ
fCLKn > 1 MHz
—
10
s
Spread Spectrum Frequency
Deviation
SSDEV
Down spread
–0.5
—
–2.5
%
Spread Spectrum Modulation
Rate
SSMOD
30
31.5
33
kHz
*Note: Contact Silicon Labs for VCXO operation at 2.5 V.
Table 4. Input Characteristics
(VDD = 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
VC Input Resistance
100
—
k
P0-P3 Input Low Voltage
VIL-P0-3
–0.1
—
0.3 x VDD
V
P0-P3 Input High Voltage
VIH_P0-3
0.7 x VDD
—3.60
V
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