tTEMP Max phase changes from –40 to +85 °" />
參數(shù)資料
型號： SI5369A-C-GQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 3/84頁
文件大?。?/td> 0K
描述： IC CLK MULT JITTER ATTEN 100TQFP
標(biāo)準(zhǔn)包裝： 90
系列： DSPLL®
類型： *
PLL： 是
輸入： LVCMOS
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 4:5
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.417GHz
除法器/乘法器： 是/是
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
Si5369
Rev. 1.0
11
Phase Change due to
Temperature
Variation1
tTEMP
Max phase changes from
–40 to +85 °C
—300
500
ps
PLL Performance
(fin = fout = 622.08 MHz; BW = 7 Hz; LVPECL, XAXB = 114.285 MHz)
Lock Time2
tLOCKMP
Start of ICAL to
of LOL
—
0.8
1.0
s
Settle Time2
tSETTLE
Start of ICAL to FOUT
within 5 ppm of final value
—4.2
5.0
s
Output Clock Phase
Change
tP_STEP
After clock switch
f3
128 kHz
—200
—
ps
Closed Loop Jitter
Peaking
JPK
—0.05
0.1
dB
Jitter Tolerance
JTOL
Jitter Frequency
Loop
Bandwidth
5000/BW
—
ns pk-pk
Phase Noise
fout = 622.08 MHz
CKOPN
100 Hz Offset
—
–95
—
dBc/Hz
1 kHz Offset
—
–110
—
dBc/Hz
10 kHz Offset
—
–117
—
dBc/Hz
100 kHz Offset
—
–118
—
dBc/Hz
1 MHz Offset
—
–131
—
dBc/Hz
Spurious Noise
SPSPUR
Max spur @ n x F3
(n
1, n x F3 < 100 MHz)
—–67
—
dBc
Table 3. AC Specifications (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Notes:
1. Input to output phase skew after an ICAL is not controlled and can assume any value.
2. Lock and settle time performance is dependent on the frequency plan and the XAXB reference frequency. Please visit
the Silicon Labs Technical Support web page at: https://www.silabs.com/support/pages/contacttechnicalsupport.aspx
to submit a technical support request regarding the lock time of your frequency plan.
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PDF描述
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Si5369B-C-GQ 功能描述:時鐘發(fā)生器及支持產(chǎn)品 LW LOOP BW AR CLK MULT/JITTER 4IN 5OUT RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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