參數(shù)資料
型號(hào)： ST72P621J4B1
廠商： STMICROELECTRONICS
元件分類(lèi)： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDIP32
封裝： PLASTIC, SDIP-32
文件頁(yè)數(shù)： 25/136頁(yè)
文件大?。?/td> 2475K
代理商： ST72P621J4B1
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120/136
12.12 10-BIT ADC CHARACTERISTICS
Subject to general operating conditions for VDD, fCPU, and TA unless otherwise specified
Figure 82. RAIN max. vs fADC with CAIN=0pF
4)
Figure 83. Recommended CAIN/RAIN values
5)
Figure 84. Typical Application with ADC
Notes:
1. Unless otherwise specified, typical data are based on TA=25°C and VDD-VSS=5V. They are given only as design guide-
lines and are not tested.
2. When VDDA and VSSA pins are not available on the pinout, the ADC refers to VDD and VSS.
3. Any added external serial resistor will downgrade the ADC accuracy (especially for resistance greater than 10k
). Data
based on characterization results, not tested in production.
4. CPARASITIC represents the capacitance of the PCB (dependent on soldering and PCB layout quality) plus the pad ca-
pacitance (3pF). A high CPARASITIC value will downgrade conversion accuracy. To remedy this, fADC should be reduced.
5. This graph shows that depending on the input signal variation (fAIN), CAIN can be increased for stabilization and to allow
the use of a larger serial resistor (RAIN). It is valid for all fADC frequencies ≤ 4MHz.
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
fADC
ADC clock frequency
0.4
4
MHz
VAIN
Conversion voltage range 2)
VSSA
VDDA
V
RAIN
External input impedance
see
and
k
CAIN
External capacitor on analog input
pF
fAIN
Variation frequency of analog input
signal
Hz
CADC
Internal sample and hold capacitor
6
pF
tCONV
Conversion time
fADC=4MHz
28
s
112
1/fADC
0
5
10
15
20
25
30
35
40
45
010
30
70
CPARASITIC (pF)
Ma
x
.R
AI
N
(Kohm
)
4 MHz
2 MHz
1 MHz
0.1
1
10
100
1000
0.01
0.1
1
10
fAIN(KHz)
Ma
x
.R
AI
N
(Kohm
)
Cain 10 nF
Cain 22 nF
Cain 47 nF
AINx
ST72XXX
VDD
IL
±1
A
VT
0.6V
VT
0.6V
CADC
6pF
VAIN
RAIN
10-Bit A/D
Conversion
2k
(max)
CAIN
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PDF描述
ST72P621J4T1 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO34
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