參數資料
型號： ST92195C8T1/XXX
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 16-BIT, OTPROM, 24 MHz, MICROCONTROLLER, PQFP64
封裝： TQFP-64
文件頁數： 243/250頁
文件大?。?/td> 3010K
代理商： ST92195C8T1/XXX
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ST92195 ST92T195 ST92E195 - TELETEXT DISPLAY STORAGE RAM INTERFACE
TDSRAM (Cont’d)
7.3.4.3 Control Registers
RAM BUFFER CONTROL REGISTER (BUFC)
R248 - Read/Write
Register Page: 38
Reset Value: 0000 1000 (08h)
Bits 7:6 = Reserved, keep in reset state.
Bit 5 = PEF:
Parity Error Flag.
This bit is set by hardware, when a parity error has
occurred during the 40 byte transfer (in any write
mode).
PEF has to be reset by software before starting
another MBT.
Bit 4 = BADU:
Buffer Address Down/Up.
This bit is set and cleared by software.
0: Address counter in incrementation mode
1: Address counter in decrementation mode
Bits 3:1 = MOD[2:0]:
Multi-Byte Transfer Mode
Select Bits.
Programming these bits, allows the user to choose
With the chosen coding, MOD2 serves at the
same time as a buffer read/write signal.
The selected mode is memorised when “BUSY” is
set. Any further modification of the 3 bits will only
be taken into account for the next MBT. The reset
value corresponds to a read access of the RAM.
Bit 0 = BUSY:
Multi-Byte Transfer Busy Bit (R/W)
When this bit is set by software, the RAM interface
starts a 40 byte transfer. As long as this “busy flag”
is set, the RAM interface doesn't accept a new
transfer request (buffer is “busy”). BUSY is auto-
matically reset when the transfer has been fin-
ished. The RAM access slots, reserved for the
MBT, are used for direct CPU access when BUSY
is “0”.
70
0
PEF BADU MOD2 MOD1 MOD0 BUSY
MOD2
MOD1
MOD0
Selected Mode
0
Write only
0
1
Write with parity reject
0
1
0
Parity cancelled on write
01
1
Write with parity reject &
parity cancelled on write
1
-
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PDF描述
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參數描述
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