參數(shù)資料
型號： TMP86PM74AFG
廠商： Toshiba Corporation
英文描述： Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.3 to 6.6; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35
中文描述： 8位微控制器
文件頁數(shù)： 112/190頁
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代理商： TMP86PM74AFG
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Page 102
10. 8-Bit TimerCounter 3 (TC3)
10.1 Configuration
TMP86PM74AFG
10.3.2 Event Counter Mode
In the event counter mode, the up-counter counts up at the edge of the input pulse to the TC3 pin. Either the
rising or falling edge of the input pulse is programmed as the count up edge in TC3SEL<TC3INV>.
When a match between the up-counter and TC3DRA value is detected, an INTTC3 interrupt is generated and
up-counter is cleared. After being cleared, the up-counter restarts counting at each edge of the input pulse to
the TC3 pin. Since a match between the up-counter and TC3DRA value is detected at the edge opposite to the
selected edge, an INTTC3 interrupt request is generated at the edge opposite to the selected edge immediately
after the up-counter reaches the value set in TC3DRA.
The maximum applied frequencies are shown in Table 10-2. The pulse width larger than one machine cycle
is required for high-going and low-going pulses.
Setting TC3CR<ACAP> to 1 captures the up-counter value into TC3DRB with the auto-capture function.
The count value during a timer operation can be checked by the read instruction to TC3DRB.
Note:00H which is stored in the up-counter immediately after detection of a match is not captured into TC3DRB.
(Figure 10-2)
Figure 10-4 Event Counter Mode Timing Chart (TC3SEL<TC3INV> = 0)
Example :Inputting 50 Hz pulse to TC3, and generating interrupts every 0.5 s
LD
(TC3SEL), 00000000B
: Selects the count-up edge.
LD
(TC3CR), 00001110B
: Sets the clock mode
LD
(TC3DRA), 19H
: 0.5 s
÷
1/50
=
25
=
19H
LD
(TC3CR), 00011110B
: Starts TC3.
Table 10-2 Maximum Frequencies Applied to TC3
Minimum Pulse Width
NORMAL1/2, IDLE1/2 mode
SLOW1/2, SLEEP1/2 mode
High-going
2
2
/fc
2
2
/fs
Low-going
2
2
/fc
2
2
/fs
n
INTTC3 interrupt
TC3 pin input
Counter
TC3DRA
Match detect
Counter clear
Timer start
0
1
2
3
n
0
1
2
3
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