參數(shù)資料
型號： TMP86PM74AFG
廠商： Toshiba Corporation
英文描述： Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.3 to 6.6; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35
中文描述： 8位微控制器
文件頁數(shù)： 70/190頁
文件大小： 1557K
代理商： TMP86PM74AFG
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Page 60
5. I/O Ports
5.6 Port P5 (P53 to P50)
TMP86PM74AFG
5.6
Port P5 (P53 to P50)
Port P5 is a 4-bit general-purpose input/output port. Each bit of the port can be configured for either input or out-
put separately, using the P5 port input/output control register (P5CR). A reset clears the P5CR to “0”, placing port P5
in input mode. A reset also initializes the P5 port output latch (P5DR) to “0”.
P50, P51, and P52 can work not only as an input/output port but also, respectively, for the
INT0
, INT1, INT2 and
TC1 functions. To use these functions, place the corresponding pins in input mode.
P53 can work not only as a port but also as, respectively, the
DVO
function. To use the
DVO
function, place the
respective pin in output mode.
Figure 5-7 Port P5
Note: If a port is in input mode, it senses the state of an input to its pins. If some pins of the port are in input mode, and others are
in output mode, the content of the output latch related to a port pin that is in input mode may be changed when a bit manip-
ulation instruction is executed on the port.
P5DR
(0005H)
7
6
5
4
3
2
1
0
P53
DVO
P52
INT2
TC1
P51
INT1
P50
INT0
(Initial value: **** 0000)
P5CR
(000DH)
7
6
5
4
3
2
1
0
(Initial value: **** 0000)
P5CR
I/O control for port P5
(This register can be set on bit
basis.)
0: Input mode
1: Output mode
R/W
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