參數(shù)資料
型號： TMP86PM74AFG
廠商： Toshiba Corporation
英文描述： Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.3 to 6.6; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35
中文描述： 8位微控制器
文件頁數(shù)： 126/190頁
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代理商： TMP86PM74AFG
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Page 116
12. Synchronous Serial Interface (SIO)
12.3 Function
TMP86PM74AFG
12.3 Function
12.3.1 Serial clock
12.3.1.1 Clock source
One of the following clocks can be selected using SIOCR1<SCK>.
(1)
Internal clock
A clock having the frequency selected with SIOCR1<SCK> (except for “111”) is used as the serial
clock. The
SCK
pin output goes high when transfer starts or ends.
Note: Do not make such a setting that the serial clock rate will exceed 1 Mbps.
(2)
External clock
Setting SIOCR1<SCK> to “111” causes an external clock to be selected. A clock supplied to the
SCK
pin is used as the serial clock.
For a shift operation to be performed securely, both the high and low levels of the serial clock pulse
must be at least 4/fc. If fc = 8 MHz, therefore, the maximum available transfer rate is 976.56 Kbps.
Figure 12-2 External Clock
Table 12-2 Serial Clock Rate
SCK
Clock
Baud Rate
fc = 16 MHz
fc = 8 MHz
000
fc/2
13
1.91 Kbps
0.95 Kbps
001
fc/2
8
61.04 Kbps
30.51 Kbps
010
fc/2
6
244.14 Kbps
122.07 Kbps
011
fc/2
5
488.28 Kbps
244.14 Kbps
100
fc/2
4
976.56 Kbps
488.28 Kbps
101
fc/2
3
–
976.56 Kbps
110
fc/2
2
–
–
111
External
External
External
(1 Kbit = 1,024 bit)
SCK pin input
t
SCKL
t
SCKH
t
SCKL
, t
SCKH
t
SCKL
, t
SCKH
4/fc (High-frequency clock mode)
4/fs (Low-frequency clock mode)
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PDF描述
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