參數(shù)資料
型號(hào)： TMS320C10-14
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processors(280ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的DSP)
中文描述： 數(shù)字信號(hào)處理器（280ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的數(shù)字信號(hào)處理器）
文件頁(yè)數(shù)： 37/139頁(yè)
文件大?。?/td> 1478K
代理商： TMS320C10-14
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RL = 825
,
CL = 100 pF,
(see Figure 2)
TMS320C14, TMS320E14, TMS320P14
DIGITAL SIGNAL PROCESSORS
SPRS009C–JANUARY 1987–REVISED JULY 1991
POST OFFICE BOX 1443
HOUSTON, TEXAS 77001
37
CLOCK TIMING
switching characteristics over recommended operating conditions
PARAMETER
TEST CONDITIONS
MIN
NOM
MAX
UNIT
tc(C)
tr(C)
tf(C)
tw(CL)
tw(CH)
td(MCC)
Values were derived from characterization data and not tested.
CLKOUT cycle time
156.25
600
ns
CLKOUT rise time
10
8
72
70
45
ns
CLKOUT fall time
ns
Pulse duration, CLKOUT low
ns
Pulse duration, CLKOUT high
ns
Delay time CLKIN
↑
to CLKOUT
↓
ns
timing requirements over recommended operating conditions
MIN
39.06
NOM
40
MAX
150
10
10
UNIT
ns
tc(MC)
tr(MC)
tf(MC)
tw(MCP)
tw(MCL)
tw(MCH)
Values were derived from characterization data and not tested.
tc(C) is the cycle time of CLKOUT, i.e., 4tc(MC) (4 times CLKIN cycle time if an external oscillator is used).
Master clock cycle time
Rise time, master clock input
5
5
ns
Fall time, master clock input
ns
Pulse duration, master clock
0.45 c(MC)
0.55 c(MC)
130
ns
Pulse duration, master clock low
15
15
ns
Pulse duration, master clock high
130
ns
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PDF描述
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