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參數(shù)資料
| 型號(hào)： | TMS320C10-14 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Digital Signal Processors(280ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的DSP) |
| 中文描述： | 數(shù)字信號(hào)處理器（280ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的數(shù)字信號(hào)處理器） |
| 文件頁數(shù)： | 85/139頁 |
| 文件大?。?/td> | 1478K |
| 代理商： | TMS320C10-14 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁當(dāng)前第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁
TMS320C16
DIGITAL SIGNAL PROCESSOR
SPRS009C–JANUARY 1987–REVISED JULY 1991
POST OFFICE BOX 1443
HOUSTON, TEXAS 77001
85
MEMORY AND PERIPHERAL INTERFACE TIMING
switching characteristics over recommended operating conditions
PARAMETER
MIN
NOM
MAX
UNIT
td1
td2
td3
td4
td5
td6
td7
td8
td9(CLK)
td9(MEN)
td10(CLK)
td10(WE)
tv
th(A-WMD)
tsu(A-MD)
Delay time, MEN
↑
, MWE
↑
, IOEN
↑
, IOWE
↑
, to next address bus valid
0
35
ns
Delay time, CLKOUT
↓
to MEN
↓
1/4tc(C)– 5
– 3
1/4tc(C)– 5
– 3
1/2tc(C)– 5
– 3
1/4tc(C)+12
ns
Delay time, CLKOUT
↓
to MEN
↑
6
ns
Delay time, CLKOUT
↓
to IOEN
↓
1/4tc(C)+12
ns
Delay time, CLKOUT
↓
to IOEN
↑
6
ns
Delay time, CLKOUT
↓
to MWE
↓
, IOWE
↓
1/2tc(C)+12
ns
Delay time, CLKOUT
↓
to MWE
↑
, IOWE
↑
6
ns
Delay time, MWE
↓
, IOwE
↓
, data bus out valid
0
ns
Delay time, CLKOUT
↓
to data bus starts to be driven
1/4tc(C)– 5
1/4tc(C)
ns
Delay time, MEN
↑
, to data bus starts to be driven
ns
Delay time, CLKOUT
↓
to data bus stops being driven
15
ns
Delay time, MWE
↑
, IOWE
↑
, data bus stops being driven
20
ns
Data bus OUT valid after MWE
↑
, IOWE
↑
5
10
ns
Address bus hold time after MWE
↑
, MEN
↑
, IOWE
↑
, or IOEN
↑
0
2
ns
Address bus setup time prior to MEN
↓
, IOEN
↓
5
ns
timing requirements over recommended operating conditions
MIN
35
MAX
UNIT
ns
tsu(D)
th(D)
Setup time, data bus valid prior to MEN
↑
, IOEN
↑
Hold time, data bus held valid after MEN
↑
, IOEN
↑
0
ns
RESET (RS) TIMING
switching characteristics over recommended operating conditions
PARAMETER
MIN
MAX
UNIT
ns
td11
tdis(R)
Delay time, IOEN
↑
, IOWE
↑
, MWE
↑
, and MEN
↑
from RS
1/2tc(C)+50
1/4tc(C)+50
Data bus disable time after RS
ns
timing requirements over recommended operating conditions
MIN
MAX
UNIT
tsu(R)
tw(R)
Reset (RS) setup time prior to CLKOUT
30
ns
RS pulse duration
5tc(C)
ns
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PDF描述 |
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參數(shù)描述 |
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