參數(shù)資料
型號(hào)： TMS320C242FNS
元件分類： 數(shù)字信號(hào)處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號(hào)處理器
文件頁數(shù)： 2/66頁
文件大?。?/td> 803K
代理商： TMS320C242FNS
TMS320C242
DSP CONTROLLER
SPRS063B – DECEMBER 1997 – REVISED DECEMBER 1999
2
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
Table of Contents
Description
Device Features
FN Package, 68-Pin PLCC, ’C242
PG Package, 64-Pin QFP, ’242
Terminal Functions - ’C242 PG and FN Packages
Functional Block Diagram
Architectural Overview
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System-Level Functions
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Device Memory Map
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Memory Map
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Peripheral Memory Map
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Digital I/O and Shared Pin Functions
Digital I/O Control Registers
Device Reset and Interrupts
Clock Generation
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Low-Power Modes
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Functional Block Diagram
of the ’24x DSP CPU
’24x Legend for the Internal Hardware
’C242 DSP Core CPU
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Internal Memory
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Peripherals
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Event-Manager (EV2) Module
Analog-to-Digital Converter (ADC) Module
A/D Overview
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Serial Communications Interface (SCI) Module
Watchdog (WD) Timer Module
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4
5
6
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10
10
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15
23
23
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30
30
34
34
36
38
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Scan-Based Emulation
Development Support
Nomenclature
Documentation Support
Absolute Maximum Ratings
Recommended Operating Conditions
Electrical Characteristics
Parameter Measurement Information
Signal Transition Levels
Timing Parameter Symbology
General Notes on Timing Parameters
Clock Characteristics and Timings
Clock Options
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Ext Reference Crystal/Clock w/PLL Circuit Enabled 48
Low-Power Mode Timings
RS Timings
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XF, BIO, and MP/MC Timings
Timing Event Manager Interface
PWM Timings
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Capture and QEP Timings
Interrupt Timings
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General-Purpose Input/Output Timings
10-Bit Dual Analog-to-Digital Converter (ADC)
ADC Operating Frequency
ADC Input Pin Circuit
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Internal ADC Module Timings
Register File Compilation
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Mechanical Data
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40
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47
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52
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56
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A
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