參數(shù)資料
型號(hào): TMX320C6474ZUN
廠商: TEXAS INSTRUMENTS INC
元件分類: 消費(fèi)家電
英文描述: SPECIALTY CONSUMER CIRCUIT, PBGA561
封裝: 23 X 23 MM, ROHS COMPLIANT, PLASTIC, FCBGA-561
文件頁(yè)數(shù): 93/204頁(yè)
文件大小: 2220K
代理商: TMX320C6474ZUN
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7.21 Antenna Interface Subsystem
7.21.1 Antenna Interface System (AIF) Register Description(s)
TMS320C6474
Multicore Digital Signal Processor
SPRS552 – OCTOBER 2008
www.ti.com
The Antenna Interface Subsystem (AIF) consists of the Antenna Interface module and two SERDES
macros. The AIF relies on the performance SerDes macro (high-speed serial link) with a logic layer for the
OBSAI RP3 and CPRI protocols. The AIF is used to connect to the backplane for transmission and
reception of antenna data, as well as to additional device peripherals.
The AIF supports OBSAI/CPRI daisy chaining between DSPs:
OBSAI - 768Mbps, 1.536Gbps, 3.072Gbps link rates supported
CPRI - 614.4Mbps, 1.2288Gbps, 2.4576Gbps link rates supported
OBSAI and CPRI standards compliant antenna interface
6 configurable (Full Duplex) high-speed serial links in either OBSAI or CPRI modes that can support a
variety of data rates:
Supports star or daisy chain topologies.
Each link can be used for uplink or downlink.
Multiple slower links can be combined into faster speed links.
Controls Word content supplied via DSP software.
The AIF is a slave peripheral, accepting all transactions from the DMA switch fabric, providing uplink data
to device memory and transmitting downlink, delayed stream, and PIC data from device memory. Each
link of the antenna interface includes a differential receive and transmit signal pair.
Table 7-77. AIF Receive and Transmit Signal Pairs
PIN NAMES
I/O
NUMBER
DESCRIPTION
AIFTXN [5:0]
OUT
6
Antenna Interface Links 0-5 Transmit (Neg) Data Lines.
AIFTXP [5:0]
OUT
6
Antenna Interface Links 0-5 Transmit (Pos) Data Lines.
AIFRXN [5:0]
IN
6
Antenna Interface Links 0-5 Receive (Neg) Data Lines.
AIFRXP [5:0]
IN
6
Antenna Interface Links 0-5 Receive (Pos) Data Lines.
Table 7-78. Antenna Interface System Registers
HEX ADDRESS
ACRONYM
REGISTER NAME
02BC 0000
AIF_PD
AI Peripheral ID
02BC 0004
AIF_GLOBAL_CFG
AI Global Configuration
02BC 0008
AIF_EMU_CNTL
AI Emulation Control
02BC 000C
VC_BUS_ERR
VC Bus Error Register
02BC 0010 - 02BC 2FFC
-
Reserved
02BC 3000
CD_OUT_MUX_SEL_CFG
Combiner - Decombiner Output Mux Select Config
Register 0
02BC 3004
CD_CB_SRC_SEL_CFG
Combiner Source Select Config Register
02BC 3008
CD_CB_OFFSET_CFG
Combiner Alignment Offset Config Register
02BC 300C
CD_CB_VALID_WIND_CFG
Combiner Valid Window Config Register
02BC 3010
CD_DC_SRC_SEL_CFG
Decombiner Source Select Config Register
02BC 3014
CD_DC_DST_SEL_CFG
Decombiner Destination Select Config Register
02BC 3018 - 02BC 307C
-
Reserved
02BC 3080
CD_STS
Combiner - Decombiner Status Register
02BC 3084 - 02BC 3FFC
-
Reserved
02BC 4000
LINK0_CFG
Link 0 Configuration Register
02BC 4004 - 02BC 47FC
-
Reserved
02BC 4800
LINK1_CFG
Link 1 Configuration Register
Peripheral Information and Electrical Specifications
182
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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TMX320C6657CZH 制造商:Texas Instruments 功能描述:2 CORE PG1.0 COMMERCIAL TEMP 1.0GHZ - Trays 制造商:Texas Instruments 功能描述:IC DSP FIX/FLOAT POINT 625FCBGA
TMX320C6670ACYP 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC TMX C6670-A w/out Encryption RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
TMX320C6670CYP 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Multicore Fixed & Floating-Point SOC RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
TMX320C6672ACYP25 制造商:Texas Instruments 功能描述:TMX C6672 PG2.0 COMMTEMP 1.25GHZ - Trays 制造商:Texas Instruments 功能描述:IC DSP FIX/FLOAT POINT 841FCBGA