參數(shù)資料
型號(hào): TS88915T
英文描述: TS88915T [Updated 6/02. 19 Pages] Low Skew CMOS PLL Clock Driver. 3 state 70 and 100 MHZ versions
中文描述: TS88915T [更新6月2日。 19頁(yè)]低偏移的CMOS PLL時(shí)鐘驅(qū)動(dòng)器。 3國(guó)70和100兆赫的版本
文件頁(yè)數(shù): 2/19頁(yè)
文件大小: 333K
代理商: TS88915T
2
TS88915T
2122A–HIREL–06/02
Introduction
The TS88915T is a CMOS PLL Clock Driver using phase-locked loop (PLL) technology.
The PLL allows the high current and low skew outputs to lock onto a single input and
distribute it with essentially zero delay to multiple components on a board. The PLL also
allows the TS88915T to multiply a low frequency input clock and distribute it locally at a
higher (2X) system frequency. Multiple 88915’s can lock onto a single reference clock,
which is ideal for applications when a central system clock must be distributed synchro-
nously to multiple boards (see Figure 12).
Figure 1.
TS88915T Block Diagram (All Versions)
FEEDBACK
SYNC[0]
SYNC[1]
REF_SEL
PLL_EN
FREQ_SEL
OE/RST
DIVIDE
BY TWO
MUX
0
1
(÷1)
(÷2)
M
U
X
1
0
M
U
X
0
1
PHASE/FREQ.
DETECTOR
EXT. REC NETWORK
(RC1 pin)
VOLTAGE
CONTROLLED
OSCILLATOR
CHARGE PUMP/
LOOP FILTER
LOCK
2X_Q
Q0
Q1
Q2
Q3
Q4
Q5
Q/2
D
Q
Q
R
CP
D
Q
Q
R
CP
D
Q
Q
R
CP
D
Q
Q
R
CP
D
Q
Q
R
CP
D
Q
Q
R
CP
D
Q
Q
R
CP
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PDF描述
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