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參數(shù)資料
| 型號： | UPD17072 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機 |
| 文件頁數(shù)： | 179/226頁 |
| 文件大小： | 1250K |
| 代理商： | UPD17072 |
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μ
PD17072,17073
179
Figure 19-3. Releasing Clock Stop by CE Reset
3 V
0 V
H
L
H
L
V
DD
CE pin
X
OUT
pin
3 V
0 V
H
L
H
L
V
DD
CE pin
X
OUT
pin
125 ms
or more
STOP s instruction
Program starts from address 0 (CE reset)
If the clock stop instruction is not used, the operation is performed as follows:
Program starts from address 0 (CE reset)
CE reset is effected in synchronization
with next setting of basic timer 0 carry
FF after CE pin goes high
0
-t
SET
Note
This voltage is called power-ON clear voltage. The maximum value of the power-ON clear voltage is 1.8
V, and the actual value is in a range not exceeding this maximum value. For details, refer to
20.4.1 Power-
ON clear voltage
.
19.3.4 Releasing clock stop status by power-ON reset
Figure 19-4 illustrates how the clock stop status is released by power-ON reset.
When the clock stop status is released by power-ON reset, the power failure detection circuit operates.
Figure 19-4. Releasing Clock Stop by Power-ON Reset
3 V
0 V
H
L
H
L
V
DD
CE pin
X
OUT
pin
3 V
0 V
H
L
H
L
V
DD
CE pin
X
OUT
pin
1.8 V
Note
125 ms
or more
STOP s instruction
Program starts from
address 0 (power-ON reset)
If the clock stop instruction is not used, the operation is performed as follows:
125 ms
or more
Oscillation stops
Program starts from
address 0 (power-ON reset)
1.8 V
Note
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PDF描述 |
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