參數(shù)資料
型號： UPD17072
廠商： NEC Corp.
英文描述： 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM
中文描述： 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機
文件頁數(shù)： 189/226頁
文件大小： 1250K
代理商： UPD17072
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μ
PD17072,17073
189
20.2 Reset Function
The power-ON reset is effected when supply voltage V
DD
has risen from a specific level, and the CE reset is effected
when the CE pin goes high from low.
The power-ON reset is to initialize the program counter, stack, system register, basic timer 0 carry FF and control
register, and execute the program from address 0000H.
The CE reset is to initialize part of the program counter, stack, system register, and peripheral control register,
and execute the program from address 0000H.
The main differences between the power-ON reset and CE reset are the contents of the peripheral control register
to be initialized, and the operation of the power failure detector circuit, which is to be described in 20.6.
The power-ON reset and CE reset are controlled by the reset signals IRES, RES, and RESET that are output from
the reset control circuit shown in Figure 20-1.
Table 20-1 shows the relations among the IRES, RES, and RESET signals, power-ON reset, and CE reset.
The reset control circuit also operates when the clock stop instruction (STOP s) described in 19. STANDBY has
been executed.
The following 20.3 and 20.4 respectively describe the CE reset and power-ON reset.
20.5 describes the relations between the CE reset and power-ON reset.
Table 20-1. Relations between Internal Reset Signal and Each Reset
Output signal
Internal reset signal
At CE reset
At power-
ON reset
At clock stop
Contents controlled by each reset signal
IRES
×
Forcibly sets device in halt status, which is
released by setting basic timer 0 carry FF.
RES
×
Initializes part of peripheral control register
RESET
Initializes part of program counter, stack, system
register, and peripheral control register.
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PDF描述
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