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參數(shù)資料
| 型號： | UPD17072 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位單芯片的數(shù)字調諧系統(tǒng)硬件單片機 |
| 文件頁數(shù)： | 186/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17072 |
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μ
PD17072,17073
186
19.6.4 Inputting signal to CE pin
The CE pin does not accept a low- or high-level signal less than 200
μ
s in order to protect the system from
malfunctioning due to noise.
The level of the signal input to the CE pin can be detected by using the CE flag of the CE pin status detection.
Figure 19-5 shows the relations between the input signal and CE flag.
Figure 19-5. Relations between Signal Input to CE Pin and CE Flag
19.6.5 Configuration and functions of CE pin status detection register
The CE pin status detection register detects the level of the signal input to the CE pin.
The configuration and functions of this register are illustrated below.
Figure 19-6. Configuration of CE Pin Status Detection Register
Name
Flag symbol
Address
Read/
Write
CE pin status
detection register
(BANK1)
52H
R
C
E
0
Detects status of CE pin
b
3
b
2
b
1
b
0
0
1
0
0
0
_
_
_
Power-ON
Clock stop
CE
Low level
High level
Fixed to "0"
0
0
At
reset
Remark
–: Determined by status of pin
The CE flag does not change even if a low or high level signal less than 200
μ
s is input.
H
L
1
0
CE pin
CE flag
less than
200 s
200 s
CE reset
PLL enabled
STOP s invalid (NOP)
PLL disabled
STOP s valid
PLL disabled
STOP s invalid (NOP)
CE reset is effected in
synchronization with
next setting of
basic timer 0 carry FF
less than
200 s
200 s
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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