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參數(shù)資料
| 型號(hào)： | UPD46128512-X |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-BIT CMOS MOBILE SPECIFIED RAM 8M-WORD BY 16-BIT EXTENDED TEMPERATURE OPERATION |
| 中文描述： | 128兆位CMOS移動(dòng)指明內(nèi)存800萬(wàn)字由16位溫度范圍 |
| 文件頁(yè)數(shù)： | 41/82頁(yè) |
| 文件大小： | 817K |
| 代理商： | UPD46128512-X |
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Preliminary Data Sheet M17507EJ2V0DS
41
μ
PD46128512-X
Figure 7-7. Asynchronous Read Cycle Timing Chart 5 (/CE1, /OE Controlled)
/CE1 (Input)
Address (Input)
DQ (Output)
High-Z
High-Z
High-Z
t
RC
/OE (Input)
t
RC
t
ACE
t
AA
t
OLCH
A1
A2
A3
t
CLZ
t
OE
t
OHZ
t
CHZ
t
OHAH
t
CHAH
/LB, /UB (Input)
t
CLOL
t
OLZ
t
OHZ
t
OHAH
t
ASO
t
OLZ
t
ASO
t
OE
Data Out Q1
Data Out Q2
Cautions 1. In read cycle, CE2 and /WE should be fixed HIGH.
2. /ADV should be fixed LOW or toggled HIGH
→
LOW
→
HIGH. CLK should be fixed HIGH or LOW.
Figure 7-8. Asynchronous Read Cycle Timing Chart 6 (Address Controlled)
/CE1 (Input)
Address (Input)
Data Out Q2
DQ (Output)
t
RC
/OE (Input)
Data Out Q1
t
AA
A1
A2
A3
t
RC
t
AA
t
OH
t
OH
t
OH
/LB, /UB (Input)
L
L
L
t
AX
t
AX
Cautions 1. In read cycle, CE2 and /WE should be fixed HIGH.
2. /ADV should be fixed LOW or toggled HIGH
→
LOW
→
HIGH. CLK should be fixed HIGH or LOW.
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