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參數(shù)資料
| 型號： | UPD703217 |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 716/757頁 |
| 文件大?。?/td> | 4410K |
| 代理商： | UPD703217 |
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CHAPTER 26 ELECTRICAL SPECIFICATIONS
User
’
s Manual U15862EJ3V0UD
716
(b) CLKOUT synchronous: In multiplex bus mode
(T
A
=
40 to
+
85
°
C, V
DD
= EV
DD
= AV
REF0
= 4.0 to 5.5 V, 4.0 V
≤
BV
DD
≤
V
DD
, 4.0 V
≤
AV
REF1
≤
V
DD
, V
SS
= EV
SS
=
BV
SS
= AV
SS
= 0 V, C
L
= 50 pF) (1/2)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
Delay time from CLKOUT
↑
to address
t
DKA
<39>
0
19
ns
Delay time from CLKOUT
↑
to address
float
t
FKA
<40>
0
14
ns
Delay time from CLKOUT
↓
to ASTB
t
DKST
<41>
0
23
ns
Delay time from CLKOUT
↑
to RD, WRm
t
DKRDWR
<42>
22
0
ns
Data input setup time (to CLKOUT
↑
)
t
SIDK
<43>
15
ns
Data input hold time (from CLKOUT
↑
)
t
HKID
<44>
0
ns
Data output delay time from CLKOUT
↑
t
DKOD
<45>
19
ns
WAIT setup time (to CLKOUT
↓
)
t
SWTK
<46>
15
ns
WAIT hold time (from CLKOUT
↓
)
t
HKWT
<47>
0
ns
HLDRQ setup time (to CLKOUT
↓
)
t
SHQK
<48>
15
ns
HLDRQ hold time (from CLKOUT
↓
)
t
HKHQ
<49>
0
ns
Delay time from CLKOUT
↑
to bus float
t
DKF
<50>
20
ns
Delay time from CLKOUT
↑
to HLDAK
t
DKHA
<51>
20
ns
Remarks 1.
m = 0, 1
2.
The values in the above specifications are values for when clocks with a 1:1 duty ratio are input from X1.
(T
A
=
40 to
+
85
°
C, V
DD
= EV
DD
= AV
REF0
= 2.7 to 5.5 V, 2.7 V
≤
BV
DD
≤
V
DD
, 2.7 V
≤
AV
REF1
≤
V
DD
, V
SS
= EV
SS
=
BV
SS
= AV
SS
= 0 V, C
L
= 50 pF) (2/2)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
Delay time from CLKOUT
↑
to address
t
DKA
<39>
0
19
ns
Delay time from CLKOUT
↑
to address
float
t
FKA
<40>
0
18
ns
Delay time from CLKOUT
↓
to ASTB
t
DKST
<41>
0
55
ns
Delay time from CLKOUT
↑
to RD, WRm
t
DKRDWR
<42>
22
0
ns
Data input setup time (to CLKOUT
↑
)
t
SIDK
<43>
30
ns
Data input hold time (from CLKOUT
↑
)
t
HKID
<44>
0
ns
Data output delay time from CLKOUT
↑
t
DKOD
<45>
19
ns
WAIT setup time (to CLKOUT
↓
)
t
SWTK
<46>
25
ns
WAIT hold time (from CLKOUT
↓
)
t
HKWT
<47>
0
ns
HLDRQ setup time (to CLKOUT
↓
)
t
SHQK
<48>
25
ns
HLDRQ hold time (from CLKOUT
↓
)
t
HKHQ
<49>
0
ns
Delay time from CLKOUT
↑
to bus float
t
DKF
<50>
40
ns
Delay time from CLKOUT
↑
to HLDAK
t
DKHA
<51>
40
ns
Remarks 1.
m = 0, 1
2.
The values in the above specifications are values for when clocks with a 1:1 duty ratio are input from X1.
相關(guān)PDF資料 |
PDF描述 |
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