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參數資料
| 型號： | UPD75236GJ |
| 廠商： | NEC Corp. |
| 英文描述： | DIODE ZENER SINGLE 500mW 75Vz 1.7mA-Izt 0.05 0.1uA-Ir 56Vr DO35-GLASS 5K/AMMO |
| 中文描述： | 4位單片機 |
| 文件頁數： | 107/190頁 |
| 文件大小： | 1220K |
| 代理商： | UPD75236GJ |
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107
μ
PD75236
(7)
SCK0 pin output manipulation
Because the SCK0/P01 pin incorporates an output latch, static output is possible by software in addition
to normal serial clocks.
P01 output latch manipulation enables to set any number of SCK0 by software (SO0/SB0/SI0/SB1 pin is
controlled by the RELT and CMDT bits of SBIC).
SCK0/P01 pin output manipulation is described below.
Set the serial operating mode register 0 (CSIM0) (SCK0 pin: output mode, serial operation: enabled).
While serial transfer is stopped, SCK0 from the serial clock control circuit remains 1.
Manipulate the P01 output latch by a bit manipulation instruction.
Example
1 clock output to SCK0/P01 pin by software.
SEL
MB15
MOV
XA,#10000011B
MOV
CSIM0,XA
CLR1
0FF0H.1
SET1
0FF0H.1
; or CLR1 MBE
; SCK0(f
X
/2
3
), output mode
; SCK0/P01
←
0
; SCK0/P01
←
1
Fig. 4-58 SCK0/P01 Pin Configuration
The P01 output latch is mapped at bit 1 of address FF0H. RESET signal generation sets the P01 output
latch to “1”.
Note
1. It is necessary to set the P01 output latch to 1 during normal serial transfer.
2. The P01 output latch address cannot be set by “PORT0.1” as shown below. Describe address
(0FF0H.1) directly for the operand.
However, it is necessary to preset MBE = 0 or (MBE = 1 and MBS = 15) for instruction execution.
CLR1
PORT0.1
SET1
PORT0.1
CLR1
0FF0H.1
SET1
0FF0H.1
P01/SCK0
SCK0
P01 Output
Latch
and CSIM00
≠
00
Address
FF0H.1
To Internal
Circuit
From Serial Clock
Control Circuit
CSIEO = 1 and CSIM01
Use disabled
Use enabled
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