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參數(shù)資料
| 型號： | UPD75236GJ |
| 廠商： | NEC Corp. |
| 英文描述： | DIODE ZENER SINGLE 500mW 75Vz 1.7mA-Izt 0.05 0.1uA-Ir 56Vr DO35-GLASS 5K/AMMO |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 67/190頁 |
| 文件大小： | 1220K |
| 代理商： | UPD75236GJ |
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67
μ
PD75236
MPX
(3)
Timer/event counter operating modes
The count operation stop mode and the count operating mode are available by setting the mode
register for the timer/event counter operation.
The following operations are enabled irrespective of the mode register setting:
(a)
(b)
(c)
(d)
(e)
TI0 pin signal input and test (Dual-function pin P13 input testable)
Output of the timer out F/F state to PTO0
Modulo register (TMOD0) setting
Count register (T0) read
Interrupt request flag (IRQT0) set/clear/test
(i)
Count operation stop mode
When TM0 bit 2 is 0, this mode is set. In this mode, count operation is not carried out because
count pulse (CP) supply to the count register is stopped.
(ii)
Count operating mode
When TM0 bit 2 is 1, this mode is set. The count pulse selected by bits 4 to 6 is supplied to the
count register and the count operation shown in Fig. 4-28 is carried out.
The timer operation is normally started by the following operations in the described order.
Set the number of counts to the modulo register (TMOD0).
Set the operating mode, count clock and start command to the mode register (TM0).
Set the modulo register by an 8-bit data transfer instruction.
Fig. 4-28 Operation in Count Operating Mode
TI0
Internal
Clock
Count Register
(T0)
Modulo Register
(TMOD0)
Comparator
CP
Clear
INTT0
(IRQT0 Set Signal)
TOUT
F/F
PTO0
To Serial Interface
(Channel 0)
{
Match
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PDF描述 |
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