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參數(shù)資料
| 型號： | UPD75518GF |
| 廠商： | NEC Corp. |
| 英文描述： | CAT5E PATCH CABLES SNAGLESS, RED 3 FT |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 77/180頁 |
| 文件大?。?/td> | 1595K |
| 代理商： | UPD75518GF |
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77
μ
PD75518(A)
(3) Configuration and operation when the timer/pulse generator is used in the timer mode
Fig. 4-30 shows the configuration when the timer/pulse generator is used in the timer mode.
The timer mode is selected by setting bit 0 of TPGM to 1. In the timer mode, TPGM3 must be set to 1,
allowing a modulo register to be reloaded at any time.
In the timer mode, a prescaler is selected with the modulo register L (MODL), and a frequency or interrupt
interval value is set in the modulo register H (MODH). The timer starts when the TPGM1 is changed from
0 to 1.
Fig. 4-31 shows the operation timing for the MODH setting, and Table 4-7 shows the setting of a frequency
or interrupt interval.
The output to the PPO pin can be switched between the square wave output and static output. To output
a square wave, set TPGM5 and TPGM7 to 1.
Fig. 4-30 Block Diagram of the Timer/Pulse Generator (Timer Mode)
Internal bus
Modulo register L (8)
MODL
8
Modulo register H (8)
MODH
8
TPGM3
(Set to 1)
f
X
TPGM1
1/2
Frequency
divider
Prescaler select latch (5)
Modulo latch H (8)
Comparator (8)
Count register (8)
8
Clear
CP
Clear
Set
T F/F
Selec-
tor
TPGM4
TPGM5
TPGM7
INTTPG
IRQTPG
set signal
Output
buffer
PPO
Match
8
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