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參數(shù)資料
| 型號： | UPD75518GFA |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 93/180頁 |
| 文件大?。?/td> | 1595K |
| 代理商： | UPD75518GFA |
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93
μ
PD75518(A)
(3) Shift register (SIO0)
Fig. 4-37 shows the configuration of peripheral hardware of shift register 0. SIO0 is an 8-bit register which
performs parallel-serial conversion and serial transfer (shift) operation in phase with the serial clock.
Serial transfer is started by writing data to SIO0.
In tansmission, data written to SIO0 is output on the serial output (SO0) or serial data bus (SB0/SB1). In
reception, data is read from the serial input (SI0) or SB0/SB1 into SIO0.
Data can be read from or written to SIO0 by using an 8-bit manipulation instruction.
When the RESET signal is entered during operation, the value of SIO0 is undefined. When the RESET signal
is entered in the standby mode, the value of SIO0 is preserved.
Shift operation is stopped after 8-bit transmission or reception is completed.
Fig. 4-37 Peripheral Hardware of Shift Register 0
The timing for reading SIO0 and start of serial transfer (writing to SIO0) is as follows:
When the serial interface operation enable/disable bit (CSIE0) = 1. However, the case where CSIE0 is
set to 1 after data is written to the shift register 0 is excluded.
When the serial clock is masked after 8-bit serial transfer
SCK0 is high.
D
Q
SET
CLR
RELT
CMDT
CLK
BUSY/ACK
Internal bus
Address
comparator
Shift register (SIO0)
SO0 latch
Shift clock
N-ch open-drain output
CSIM0
相關(guān)PDF資料 |
PDF描述 |
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