參數(shù)資料
型號： XC2S100E-6FT256C
廠商： Xilinx Inc
文件頁數(shù)： 71/108頁
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描述： IC FPGA 1.8V 600 CLB'S 256-FBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-IIE
LAB/CLB數(shù)： 600
邏輯元件/單元數(shù)： 2700
RAM 位總計(jì)： 40960
輸入/輸出數(shù)： 182
門數(shù)： 100000
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FTBGA
其它名稱： 122-1208
DS077-4 (v3.0) August 9, 2013
65
Product Specification
Spartan-IIE FPGA Family: Pinout Tables
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
I/O, VREF
Bank 1, L6P
1
P178
XC2S50E,
200E, 300E
All
I/O, L6N
1
P179
XC2S50E,
200E, 300E
-
I/O
1
P180
-
I/O (DLL),
L5P
1
P181
-
GCK2, I
1
P182
-
GND
-
P183
-
VCCO
-
P184
-
GCK3, I
0
P185
-
VCCINT
-
P186
-
I/O (DLL),
L5N
0
P187
-
I/O, L4P
0
P188
XC2S50E,
200E, 300E
-
I/O, VREF
Bank 0, L4N
0
P189
XC2S50E,
200E, 300E
All
GND
-
P190
-
I/O, L3P
0
P191
XC2S50E,
200E, 300E
-
I/O, L3N
0
P192
XC2S50E,
200E, 300E
-
I/O, L2P
0
P193
XC2S50E,
100E, 200E,
300E
-
I/O, L2N
0
P194
XC2S50E,
100E, 200E,
300E
-
VCCINT
-
P195
-
VCCO
-
P196
-
GND
-
P197
-
I/O, L1P
0
P198
XC2S50E,
100E, 200E,
300E
-
I/O, L1N
0
P199
XC2S50E,
100E, 200E,
300E
XC2S100E,
150E, 200E,
300E
I/O
0
P200
-
PQ208 Pinouts (XC2S50E, XC2S100E,
XC2S150E, XC2S200E, XC2S300E)
Pad Name
Pin
LVDS
Async.
Output
Option
VREF
Option
Function
Bank
I/O
0
P201
-
I/O,
L0P_YY
0
P202
All
-
I/O, VREF
Bank 0,
L0N_YY
0
P203
All
I/O
0
P204
-
I/O
0
P205
-
XC2S200E,
300E
I/O
0
P206
-
TCK
-
P207
-
VCCO
-
P208
-
PQ208 Differential Clock Pins
Clock
Bank
P
N
Pin
Name
Pin
Name
GCK0
4
P80
GCK0, I
P81
I/O (DLL),
L31P
GCK1
5
P77
GCK1, I
P75
I/O (DLL),
L31N
GCK2
1
P182
GCK2, I
P181
I/O (DLL),
L5P
GCK3
0
P185
GCK3, I
P187
I/O (DLL),
L5N
PQ208 Pinouts (XC2S50E, XC2S100E,
XC2S150E, XC2S200E, XC2S300E)
Pad Name
Pin
LVDS
Async.
Output
Option
VREF
Option
Function
Bank
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