參數(shù)資料
型號： XC2S50E-6PQG208C
廠商： Xilinx Inc
文件頁數(shù)： 69/108頁
文件大?。?/td> 0K
描述： IC SPARTAN-IIE FPGA 50K 208-PQFP
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標準包裝： 24
系列： Spartan®-IIE
LAB/CLB數(shù)： 384
邏輯元件/單元數(shù)： 1728
RAM 位總計： 32768
輸入/輸出數(shù)： 146
門數(shù)： 50000
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
其它名稱： 122-1330
DS077-4 (v3.0) August 9, 2013
63
Product Specification
Spartan-IIE FPGA Family: Pinout Tables
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
I/O, L28P
4
P89
XC2S50E,
100E, 200E,
300E
-
VCCINT
-
P90
-
VCCO
-
P91
-
GND
-
P92
-
I/O, L27N
4
P93
XC2S50E,
100E, 200E,
300E
-
I/O, L27P
4
P94
XC2S50E,
100E, 200E,
300E
XC2S100E,
150E, 200E,
300E
I/O
4
P95
-
I/O
4
P96
-
I/O,
L26N_YY
4
P97
All
-
I/O, VREF
Bank 4,
L26P_YY
4
P98
All
I/O
4
P99
-
I/O
4
P100
-
XC2S200E,
300E
I/O,
L25N_YY
4
P101
All
-
I/O,
L25P_YY
4
P102
All
-
GND
-
P103
-
DONE
3
P104
-
VCCO
-
P105
-
PROGRAM
-
P106
-
I/O (INIT),
L24N_YY
3
P107
All
-
I/O (D7),
L24P_YY
3
P108
All
-
I/O
3
P109
-
XC2S200E,
300E
I/O
3
P110
-
PQ208 Pinouts (XC2S50E, XC2S100E,
XC2S150E, XC2S200E, XC2S300E)
Pad Name
Pin
LVDS
Async.
Output
Option
VREF
Option
Function
Bank
I/O, VREF
Bank 3,
L23N
3
P111
XC2S50E,
150E, 200E,
300E
All
I/O, L23P
3
P112
XC2S50E,
150E, 200E,
300E
-
I/O
3
P113
-
I/O
3
P114
-
I/O, L22N
3
P115
XC2S50E,
300E
XC2S100E,
150E, 200E,
300E
I/O (D6),
L22P
3
P116
XC2S50E,
300E
-
GND
-
P117
-
VCCO
-
P118
-
VCCINT
-
P119
-
I/O (D5),
L21N_YY
3
P120
All
-
I/O,
L21P_YY
3
P121
All
-
I/O,
L20N_YY
3
P122
All
-
I/O,
L20P_YY
3
P123
All
-
GND
-
P124
-
I/O, VREF
Bank 3,
L19N
3
P125
XC2S50E,
300E
All
I/O (D4),
L19P
3
P126
XC2S50E,
300E
-
I/O
3
P127
-
VCCINT
-
P128
-
I/O (TRDY)
3
P129
-
VCCO
-
P130
-
GND
-
P131
-
I/O (IRDY),
L18N_YY
2
P132
All
-
I/O,
L18P_YY
2
P133
All
-
PQ208 Pinouts (XC2S50E, XC2S100E,
XC2S150E, XC2S200E, XC2S300E)
Pad Name
Pin
LVDS
Async.
Output
Option
VREF
Option
Function
Bank
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PDF描述
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