參數(shù)資料
型號(hào)： XR16C864IQ-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 30/51頁(yè)
文件大?。?/td> 0K
描述： IC UART FIFO 128B QUAD 100QFP
標(biāo)準(zhǔn)包裝： 66
特點(diǎn)： *
通道數(shù)： 4，QUART
FIFO's： 128 字節(jié)
規(guī)程： RS232，RS485
電源電壓： 2.97 V ~ 5.5 V
帶自動(dòng)流量控制功能： 是
帶IrDA 編碼器/解碼器： 是
帶故障啟動(dòng)位檢測(cè)功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類(lèi)型： 表面貼裝
封裝/外殼： 100-BQFP
供應(yīng)商設(shè)備封裝： 100-QFP（14x20）
包裝： 托盤(pán)
其它名稱(chēng)： 1016-1277
XR16C864
36
2.97V TO 5.5V QUAD UART WITH 128-BYTE FIFO
REV. 2.2.0
EMSR[3]: Receive Direct Memory Access Request Enable
Logic 0 = Normal.
Logic 1 = Enable RX Direct Memory Access Request.
See DACK, TC, AEN, TXDRQ and RXDRQ pin
descriptions for details.
EMSR[5:4]: Extended RTS Hysteresis
TABLE 15: AUTO RTS HYSTERESIS
EMSR[7:6]: Reserved
4.12
FIFO Level Register (FLVL) - Read-Only
The FIFO Level Register replaces the Scratchpad Register (during a Read) when FCTR[6] = 1. Note that this
is not identical to the FIFO Data Count Register which can be accessed when LCR = 0xBF.
FLVL[7:0]: FIFO Level Register
This register provides the FIFO counter level for the RX FIFO or the TX FIFO or both depending on EMSR[1:0].
See Table 14 for details.
TABLE 16:
EMSR
BIT-5
EMSR
BIT-4
FCTR
BIT-1
FCTR
BIT-0
RTS#
HYSTERESIS
(CHARACTERS)
0
1
0
1
0
1
0
±4
±6
±8
0
1
0
1
0
1
0
1
±8
±16
±24
±32
1
0
1
0
1
0
1
±40
±44
±48
±52
1
0
1
0
1
0
1
±12
±20
±28
±36
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PDF描述
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