參數(shù)資料
型號(hào)： XRT74L74IB
廠商： EXAR CORP
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁(yè)數(shù)： 120/498頁(yè)
文件大?。?/td> 2941K
代理商： XRT74L74IB
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XRT74L74
4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
REV. P1.1.1
PRELIMINARY
118
Upon power up or reset, the “HEC Byte Calculator
and Insertion” feature is enabled. A “0” must be writ-
ten to this bit in order to disable this operation.
3.2.2.1.2
Configuring the “HEC Byte Calculator
and Insertion” Feature for Idle Cells
The “HEC Byte Calculation and Insertion” feature can
be separately enabled or disabled for the outbound Idle
Cells. This option is exercised by writing the appropri-
ate value to bit 1 (Idle Cell HEC CalEn) within the Tx-
CP Control Register, as depicted below.
This “Read/Write” bit-field is used for enabling or dis-
abling the “Calculation and Insertion” of the HEC byte
into the Idle Cell as illustrated below. If disabling this
feature is chosen, then the 5th octet of the Idle Cells
will be transmitted to the Transmit PLCP (or Transmit
DS3 Framer) block as programmed in the “TxCP Idle
Cell Pattern Header—Byte 5” register (Address =
68h).
Upon power up or reset, the Transmit Cell Processor
will be configured such that the HEC bytes will be cal-
culated and inserted into the fifth octet position of
each Idle Cell. A “0” must be written to this bit-field in
order to disable this feature.
3.2.2.1.3
Modulo-2 Addition of Coset
Polynomial to the HEC Byte Value
When enabled, the HEC Byte Calculator takes the
first four bytes of each cell and computes a CRC-8
value via the generating polynomial x
8
+ x
2
+ x + 1.
The BISDN Physical Layer specifications (ITU
Recommendations I.432) specifies that this CRC-8 (or
HEC) value can optionally be modulo-2 added to the
polynomial x
6
+ x
4
+ x
2
+ 1; and inserting the result of
this calculation into the fifth byte of each cell. The pur-
pose of this option is to provide protection against bit
slips. This protection is not required in transmission
systems that ensure adequate one’s density. Howev-
er, this operation does provide protection against all ze-
ros cells that could be passed to the ATM Layer during
a loss of signal condition on the transmission medium.
The ATM Forum UNI specifications also requires this
operation.
This modulo-2 addition can be enabled or disabled by
writing the appropriate value to bit 6 (Coset Enable)
1
The HEC Byte is calculated and is inserted into the 5th octet position of each valid cell.
T
ABLE
8: T
HE
R
ELATIONSHIP
BETWEEN
THE
CONTENTS
OF
B
IT
-
FIELD
5 (HEC I
NSERT
E
NABLE
)
WITHIN
THE
T
X
CP
C
ONTROL
R
EGISTER
,
AND
THE
HEC B
YTE
C
ALCULATOR
’
S
HANDLING
OF
VALID
CELLS
HEC I
NSERT
E
NABLE
R
ESULT
TxCP Control Register (Address = 60h)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Scrambler
En
Coset
Enable
HEC Insert
Enable
TDPChk
Pattern
GFC Insert
Enable
TDPErr
Interrupt
Enable
Idle Cell
HEC
CalEn
TDPErr
Interrupt
Status
R/W
R/W
R/W
R/W
R/W
R/W
R/W
RUR
1
1
1
1
0
0
x
0
T
ABLE
9: T
HE
R
ELATIONSHIP
BETWEEN
THE
CONTENTS
WITHIN
B
IT
1 (IC HEC C
ALC
E
N
)
OF
THE
“T
X
CP C
ONTROL
R
EGISTER
”
AND
THE
RESULTING
HANDLING
OF
I
DLE
C
ELLS
,
BY
THE
“HEC B
YTE
C
ALCULATOR
”
IC HEC C
ALC
E
N
R
ESULT
0
The entire programmed Idle Cell header is transmitted without Modification
1
The HEC byte is calculated, via the first four bytes of the header, and is inserted into the fifth octet
position within each Idle Cell.
相關(guān)PDF資料
PDF描述
XRT75L00D E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L02 TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
XRT75L02IV TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
XRT75L03D THREE CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
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參數(shù)描述
XRT75L00 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
XRT75L00D 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DES 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 LIU+DESYNCH 3.3V LIU+DESYNCH 3.3V RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
XRT75L00DIV 功能描述:外圍驅(qū)動(dòng)器與原件 - PCI 3.3V 1 CH E3/DS3/STS W/SONET DE-SYNCH RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
XRT75L00DIV-F 功能描述:外圍驅(qū)動(dòng)器與原件 - PCI 1-Ch DS3, E3, SONET RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
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