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參數(shù)資料
| 型號： | 28234-12 |
| 廠商： | CONEXANT SYSTEMS |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA388 |
| 封裝： | BGA-388 |
| 文件頁數(shù)： | 153/368頁 |
| 文件大?。?/td> | 4444K |
| 代理商： | 28234-12 |
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RS8234
11.0 PCI Bus Interface
ATM ServiceSAR Plus with xBR Traffic Management
11.4 PCI Bus Master Logic
N8234DSC
PRELIMINARY
11-5
Five possible sources of error are present during any PCI bus master
transaction. If the any of the following five errors occur, the bus master logic will
permanently terminate the transaction, flag an error, and cease to process any
more commands.
1.
Target Abort—The PCI transaction will terminate if the addressed target
signals a target abort. In this case, the RTA and MERROR bits in the PCI
Configuration Register space will be set and the PCI_BUS_STATUS[4] bit
in the SYS_STAT Register will be set.
2.
Master Abort—If the addressed target does not respond with an
HDEVSEL* assertion, then a master abort is flagged. In this case, the
RMA and MERROR bits in the PCI Configuration Register space will be
set and the PCI_BUS_STATUS[3] bit in the SYS_STAT Register will be
set.
3.
Parity Error—If the data parity checked during read transfers is
inconsistent with the state of the HPAR signal, then a parity error is
signaled. In this case, the DPR and MERROR bits in the PCI
Configuration Register space will be set and the PCI_BUS_STATUS[2] bit
in the SYS_STAT Register will be set.
4.
Interface Disabled—If the driver or application software on the PCI host
CPU has disabled, the RS8234 PCI bus master logic (using the M_EN bit
in the Command field of the PCI bus configuration registers), then any
attempt to perform a DMA transaction to the PCI bus will result in an
error. In this case, the MERROR and INTF_DIS bits in the PCI
configuration space will be set and the PCI_BUS_STATUS[1] bit in the
SYS_STAT Register will be set.
5.
Internal Failure—Upon a synchronization error between the DMA
coprocessor and the PCI master logic, an internal failure will be flagged. In
this case, the MERROR and INT_FAIL bits in the PCI configuration space
will be set and the PCI_BUS_STATUS[0] bit in the SYS_STAT Register
will be set.
NOTE(S):
The above errors permanently affect system level operation. Because of this the system
should be re-initialized, since full system level recovery is unlikely. The bus protocol
errors can be cleared either by a software reset of the associated status flag or flags,
i.e., RTA, RMA, or DPR, or with a reset of the PCI bus master logic using the HRST*
input pin. For example, a master abort error can be cleared by writing a logic one to the
RMA status bit in the PCI Configuration Register space, causing the status bit to be
cleared. Internal failures (attempting to initiate a master transaction with the interface
disabled, or loss of synchronization with the DMA controller) can only be reset by
applying the global reset, CONFIG0 (GLOBAL_RESET), or by asserting the HRST*
signal.
Next, the MERROR bit must be cleared. The MERROR bit in the PCI
Configuration Register drives the PCI_BUS_ERROR interrupt. To clear
this interrupt, a logic high must be written to the MERROR bit location.
The MERROR bit can also be cleared by a logic low on the HRST* input
pin.
The local processor can clear the error bits by setting CONFIG0
(PCI_ERR_RESET) to a logic high. After the errors have been cleared, the
SAR should be re-initialized.
Several fields are provided in the PCI configuration space to aid in
recovering from a PCI master error. The PCI host software can determine
that an error occurred by checking the MERROR bit. It can also determine
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 28236-12 | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA388 |
| 2885 | INTERCONNECTION DEVICE |
| 28C17AFT-20/TS | 2K X 8 EEPROM 5V, 200 ns, PDSO28 |
| 28C17AT-15/VS | 2K X 8 EEPROM 5V, 150 ns, PDSO28 |
| 28C64AX-20I/K | 8K X 8 EEPROM 5V, 200 ns, CQCC32 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 28234-13 | 制造商:Mindspeed Technologies Inc 功能描述:RS8234EBGC ATM XBR SAR - Trays 制造商:Mindspeed Technologies 功能描述:RS8234EBGC ATM XBR SAR |
| 2823418 | 功能描述:工業(yè)繼電器 ST-REL4-HG 60/21-21 RoHS:否 制造商:TE Connectivity / Kilovac 觸點形式:1 Form A (SPST-NO) 觸點電流額定值: 線圈電壓:9 VDC to 36 VDC 線圈電阻:38 Ohms 線圈電流: 切換電壓: 安裝風(fēng)格:Panel 觸點材料:Silver Palladium |
| 2823421 | 功能描述:工業(yè)繼電器 ST-REL4-HG110/21-21 RoHS:否 制造商:TE Connectivity / Kilovac 觸點形式:1 Form A (SPST-NO) 觸點電流額定值: 線圈電壓:9 VDC to 36 VDC 線圈電阻:38 Ohms 線圈電流: 切換電壓: 安裝風(fēng)格:Panel 觸點材料:Silver Palladium |
| 282342-1 | 功能描述:汽車連接器 SPLASH PROOF CONN ASSEMBLY RoHS:否 制造商:Amphenol SINE Systems 產(chǎn)品:Contacts 系列:ATP 位置數(shù)量: 型式:Female 安裝風(fēng)格: 端接類型: 觸點電鍍:Nickel |
| 2823434 | 功能描述:工業(yè)繼電器 ST-REL4-HG220/21-21 RoHS:否 制造商:TE Connectivity / Kilovac 觸點形式:1 Form A (SPST-NO) 觸點電流額定值: 線圈電壓:9 VDC to 36 VDC 線圈電阻:38 Ohms 線圈電流: 切換電壓: 安裝風(fēng)格:Panel 觸點材料:Silver Palladium |
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