參數(shù)資料
型號(hào)： 73S1217F-68MR/F/PE
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 65/140頁(yè)
文件大?。?/td> 0K
描述： IC SOC SMART CARD READER 68QFN
標(biāo)準(zhǔn)包裝： 2,500
系列： *
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73S1217F Data Sheet
DS_1217F_002
USR[7:0] Control
USRxINTSrc set to
4(ext INT0 high)
or
6(ext INT0 low)
1
0
INT5
INT4
RESETB
TC
CLR
9 BIT CNTR
RESETB
CE
PDMUX
(FF94h:bit7)
MPU
INT0
PWRDN_analog
Q
CLR
D
PWRDN
(FFF1h:bit7)
USR0
USR6
USR1
USR2
USR3
USR4
USR5
USR7
TC
CE
CLR
5 BIT CNTR
Notes:
1. The counters are clocked by the MPUCLK
2. TC - Terminal count (high at overflow)
3. CE - Count enable
RESETB
Figure 7: Detail of Power-Down Interrupt Logic
PWRDN BIT
PWRDN SIG
EXT. EVENT
INT0 to MPU
MPU STOP
ANALOG Enable
PLL CLOCKS
t1
t2
t3
t4
t5
t6
t0
t7
t0: MPU sets PWRDN bit
t1: 32 MPU clock cycles after t0, the PWRDN SIG is asserted, turning all analog functions OFF.
t2: MPU executes STOP instruction, must be done prior to t1.
t3: Analog functions go to OFF condition. No Vref, PLL/VCO, Ibias, etc.
text
text: An external event (RTC, Keypad, Card event, USB) occurs.
t4: PWRDN bit and PWRDN signal are cleared by external event.
t5: High-speed oscillator/PLL/VCO operating.
t6: After 512 MPU clock cycles, INT0 to MPU is asserted.
t7: INT0 causes MPU to exit STOP condition.
Figure 8: Power-Down Sequencing
30
Rev. 1.2
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PDF描述
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73S1217F-EB-Lite 功能描述:開(kāi)發(fā)板和工具包 - 8051 73S1217F EVB Lite w/Plug & Play/Usb RoHS:否 制造商:Silicon Labs 產(chǎn)品:Development Kits 工具用于評(píng)估:C8051F960, Si7005 核心: 接口類(lèi)型:USB 工作電源電壓:
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73S13B 制造商:QUARTZCOM 制造商全稱(chēng):QUARTZCOM the communications company 功能描述:-20 ~ +70 °C commercia l application -30 ~ +75 °C on request
73S5040G01X0A 制造商:NEX Computers 功能描述:INTEL 40GB SSD - Bulk
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