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參數(shù)資料
型號： AD5750BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 35/36頁
文件大?。?/td> 0K
描述： IC CURR/VOLT OUT DVR 32LFCSP
標準包裝： 1,500
放大器類型： 儀表
電路數(shù)： 1
轉(zhuǎn)換速率： 2 V/µs
電流 - 電源： 5.2mA
電流 - 輸出 / 通道： 24mA
電壓 - 電源，單路/雙路(±)： ±10.8 V ~ 26.4 V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應商設備封裝： 32-LFCSP-VQ（5x5）
包裝： 帶卷 (TR)
AD5750/AD5750-1
Rev. C | Page 8 of 36
TIMING CHARACTERISTICS
AVDD/AVSS = ±12 V (± 10%) to ±24 V (± 10%), DVCC = 2.7 V to 5.5 V, GND = 0 V. VOUT: RLOAD = 2 kΩ, CL = 200 pF, IOUT: RLOAD =
300 Ω. All specifications TMIN to TMAX, unless otherwise noted.
Table 3.
Parameter1, 2
Limit at TMIN, TMAX
Unit
Description
t1
20
ns min
SCLK cycle time
t2
8
ns min
SCLK high time
t3
8
ns min
SCLK low time
t4
5
ns min
SYNC falling edge to SCLK falling edge setup time
t5
10
ns min
16th SCLK falling edge to SYNC rising edge (on 24th SCLK falling edge if using PEC)
t6
5
ns min
Minimum SYNC high time (write mode)
t7
5
ns min
Data setup time
t8
5
ns min
Data hold time
t9, t10
1.5
μs max
CLEAR pulse low/high activation time
t11
5
ns min
Minimum SYNC high time (read mode)
t12
40
ns max
SCLK rising edge to SDO valid (SDO CL = 15 pF)
t13
10
ns min
RESET pulse low time
1 Guaranteed by characterization, but not production tested.
2 All input signals are specified with tR = tF = 5 ns (10% to 90% of DVCC) and timed from a voltage level of 1.2 V.
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PDF描述
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