參數(shù)資料
型號： AD9148BBPZRL
廠商： Analog Devices Inc
文件頁數(shù)： 20/72頁
文件大?。?/td> 0K
描述： IC DAC 16BIT SPI/SRL 196BGA
標(biāo)準(zhǔn)包裝： 1,500
系列： TxDAC+®
設(shè)置時(shí)間： 20ns
位數(shù)： 16
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 4
電壓電源： 單電源
功率耗散（最大）： 2.67W
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 196-LFBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 196-BGA
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 4 電流，單極
采樣率（每秒）： 1G
Data Sheet
AD9148
Rev. B | Page 27 of 72
Register Name
Addr
(Hex)
Bit
Name
Function
Default
Data Format
03
7
Binary format
Input data is in twos complement format (0) or unsigned
binary format (1).
0
6
Q first enable
Indicates I/Q data pairing on data input; I first (0), Q first (1).
0
5
Dual-port mode
Number of input data ports used.
1
Single port (0), dual port (1).
4
Bus swap
0 = normal data input bus pin out (MSB to LSB).
0
1 = inverted data input bus pin out (LSB to MSB).
3
Byte mode
0 = data input bus is 16-bit wide on each port.
0
1 = data input bus is two 8-bit wide buses on Port A.
2
Byte swap
0 = normal data input bus pin out (MSB to LSB).
0
1 = inverted data input bus pin out (LSB to MSB).
Interrupt Enable 0
04
7
Enable PLL lock lost
Enables interrupt for PLL lock lost.
0
6
Enable PLL lock
Enables interrupt for PLL lock.
0
5
Enable sync
lock lost
Enables interrupt for sync lock lost.
0
4
Enable sync lock
Enables interrupt for sync lock.
0
2
Enable FIFO
SPI aligned
Enables interrupt for FIFO SPI aligned.
0
1
Enable FIFO
Warning 1
Enables interrupt for FIFO Warning 1.
0
Enable FIFO
Warning 2
Enables interrupt for FIFO Warning 2.
0
Interrupt Enable 1
05
4
Enable AED
compare pass
Enables interrupt for AED compare pass.
0
3
Enable AED
compare fail
Enables interrupt for AED compare fail.
0
2
Enable SED
compare fail
Enables interrupt for SED compare fail.
0
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