參數(shù)資料
型號： AD9510BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 47/56頁
文件大?。?/td> 0K
描述： IC CLOCK DIST 8OUT PLL 64LFCSP
標(biāo)準(zhǔn)包裝： 750
類型： 扇出緩沖器（分配），除法器
PLL： 是
輸入： 時鐘
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:8
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.2GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
配用： AD9510-VCO/PCBZ-ND - BOARD EVALUATION FOR AD9510
AD9510/PCBZ-ND - BOARD EVALUATION FOR AD9510
Data Sheet
AD9510
Rev. B | Page 51 of 56
Reg.
Addr.
(Hex) Bit(s) Name
Description
[3:0] Divider high
Number of clock cycles divider output stays high.
48
OUT0
4A
OUT1
4C
OUT2
4E
OUT3
50
OUT4
52
OUT5
54
OUT6
56
OUT7
[7:4] Divider low
Number of clock cycles divider output stays low.
48
OUT0
4A
OUT1
4C
OUT2
4E
OUT3
50
OUT4
52
OUT5
54
OUT6
56
OUT7
[3:0] Phase offset
Phase offset (default = 0000b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
[4]
Start
Selects start high or start low (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
[5]
Force
Forces individual outputs to the state specified in start (see the previous section of this table). This
function requires that Nosync (see the next section of this table) also be set (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
相關(guān)PDF資料
PDF描述
AD9511BCPZ-REEL7 IC CLOCK DIST 5OUT PLL 48LFCSP
AD9512UCPZ-EP-R7 IC CLOCK DIST 5OUT PLL 48LFCSP
AD9512UCPZ-EP IC CLOCK DIST 5OUT PLL 48LFCSP
AD9513BCPZ-REEL7 IC CLOCK DIST 3OUT PLL 32LFCSP
AD9514BCPZ-REEL7 IC CLOCK DIST 3OUT PLL 32LFCSP
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參數(shù)描述
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