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參數(shù)資料
| 型號： | ADSP-2115BPZ-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 11/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68-PLCC |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 25MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 3kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 738 (CN2011-ZH PDF) |
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ADSP-21xx
REV. B
–19–
POWER DISSIPATION EXAMPLE
To determine total power dissipation in a specific application,
the following equation should be applied for each output:
C
× V
DD
2
× f
C = load capacitance, f = output switching frequency.
Example:
In an ADSP-2101 application where external data memory is
used and no other outputs are active, power dissipation is
calculated as follows:
Assumptions:
External data memory is accessed every cycle with 50% of the
address pins switching.
External data memory writes occur every other cycle with
50% of the data pins switching.
Each address and data pin has a 10 pF total load at the pin.
The application operates at V
DD = 5.0 V and tCK = 50 ns.
Total Power Dissipation = PINT + (C
× V
DD
2
× f )
PINT = internal power dissipation (from Figure 11).
(C
× V
DD
2
× f ) is calculated for each output:
# of
Output
Pins
× C
× V
DD
2
× f
Address, DMS 8
× 10 pF × 52 V × 20 MHz = 40.0 mW
Data, WR
9
× 10 pF × 52 V × 10 MHz = 22.5 mW
RD
1
× 10 pF × 52 V × 10 MHz = 2.5 mW
CLKOUT
1
× 10 pF × 52 V × 20 MHz = 5.0 mW
70.0 mW
Total power dissipation for this example = PINT + 70.0 mW.
ENVIRONMENTAL CONDITIONS
Ambient Temperature Rating:
TAMB = TCASE – (PD
× θ
CA)
TCASE = Case Temperature in °C
PD = Power Dissipation in W
θ
CA = Thermal Resistance (Case-to-Ambient)
θ
JA = Thermal Resistance (Junction-to-Ambient)
θ
JC = Thermal Resistance (Junction-to-Case)
Package
θ
JA
θ
JC
θ
CA
PGA
18
°C/W
9
°C/W
9
°C/W
PLCC
27
°C/W
16
°C/W
11
°C/W
PQFP
60
°C/W
18
°C/W
42
°C/W
TQFP
60
°C/W
18
°C/W
42
°C/W
SPECIFICATIONS (ADSP-2101/2105/2115/2161/2163)
CAPACITIVE LOADING
Figures 12 and 13 show capacitive loading characteristics for the
ADSP-2101, ADSP-2105, ADSP-2115, and ADSP-2161/2163.
C
L
– pF
25
150
125
100
75
50
RISE
TIME
(0.8V
-
2.0V)
–
ns
V
DD
= 4.5V
8
7
6
5
4
3
2
1
0
175
0
Figure 12. Typical Output Rise Time vs. Load Capacitance, C
L
(at Maximum Ambient Operating Temperature)
Figure 13. Typical Output Valid Delay or Hold vs. Load
Capacitance, C
L (at Maximum Ambient Operating Temperature)
C
L
– pF
25
100
125
50
75
150
VALID
OUTPUT
DELAY
OR
HOLD
–
ns
V
DD
= 4.5V
175
0
5
4
3
2
1
0
–1
–2
–3
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