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參數(shù)資料
| 型號： | ADSP-2115BPZ-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 46/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68-PLCC |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點(diǎn) |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 25MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 3kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 738 (CN2011-ZH PDF) |
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ADSP-21xx
–50–
REV. B
TIMING PARAMETERS (ADSP-2103/2162/2164)
SERIAL PORTS
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tSCK
SCLK Period
97.6
tCK
ns
tSCS
DR/TFS/RFS Setup before SCLK Low
8
ns
tSCH
DR/TFS/RFS Hold after SCLK Low
10
ns
tSCP
SCLKin Width
28
ns
Switching Characteristic:
tCC
CLKOUT High to SCLKout
24.4
39.4
0.25tCK
0.25tCK + 15
ns
tSCDE
SCLK High to DT Enable
0
ns
tSCDV
SCLK High to DT Valid
28
ns
tRH
TFS/RFSout Hold after SCLK High
0
ns
tRD
TFS/RFSout Delay from SCLK High
28
ns
tSCDH
DT Hold after SCLK High
0
ns
tTDE
TFS (alt) to DT Enable
0
ns
tTDV
TFS (alt) to DT Valid
18
ns
tSCDD
SCLK High to DT Disable
30
ns
tRDV
RFS (Multichannel, Frame Delay Zero)
20
ns
to DT Valid
CLKOUT
SCLK
TFS
RFS
DR
RFSIN
TFSIN
DT
( ALTERNATE
FRAME MODE )
t
CC
t
CC
t
SCK
t
SCP
t
SCP
t
SCS
t
SCH
t
RD
t
RH
RFSOUT
TFSOUT
t
SCDV
t
SCDE
t
SCDH
t
SCDD
t
TDE
t
TDV
t
RDV
( MULTICHANNEL MODE,
FRAME DELAY 0 {MFD = 0} )
Figure 44. Serial Ports
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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