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參數(shù)資料
| 型號： | ADSP-2115BPZ-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 44/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68-PLCC |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點(diǎn) |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 25MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 3kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 738 (CN2011-ZH PDF) |
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ADSP-21xx
REV. B
–49–
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Switching Characteristic:
tDW
Data Setup before WR High
38.8
0.5tCK – 10 + w
ns
tDH
Data Hold after WR High
14.4
0.25tCK – 10
ns
tWP
WR Pulse Width
43.8
0.5tCK – 5 + w
ns
tWDE
WR Low to Data Enabled
0
tASW
A0–A13, DMS, PMS Setup before WR Low
12.4
0.25tCK – 12
ns
tDDR
Data Disable before WR or RD Low
14.4
0.25tCK – 10
ns
tCWR
CLKOUT High to WR Low
19.4
34.4
0.25tCK – 5
0.25tCK + 10
ns
tAW
A0–A13, DMS, PMS, Setup before WR Deasserted
58.2
0.75tCK – 15 + w
ns
tWRA
A0–A13, DMS, PMS Hold After WR Deasserted
14.4
0.25tCK – 10
ns
tWWR
WR High to RD or WR Low
38.8
0.5tCK – 10
ns
w = wait states
× t
CK.
TIMING PARAMETERS (ADSP-2103/2162/2164)
MEMORY WRITE
Figure 43. Memory Write
CLKOUT
A0 – A13
D
t
WR A
WR
DMS, PMS
t
WWR
t
WP
t
AS W
t
AW
t
CWR
RD
t
DH
t
DD R
t
WDE
t
DW
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